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講演抄録/キーワード
講演名 2019-04-18 11:10
低遅延レイヤ2スイッチにおける自律型Time Aware ShaperのFPGA試作
西村和人廣田正樹寺原隆文松井秀樹富士通CS2019-5
抄録 (和) 第五世代移動通信システム(5G)では、ネットワークの効率的な利用のため、モバイルフロントホール(MFH)のレイヤ2 ネットワークへの統合が検討されている。しかし、MFH トラヒックは遅延にセンシティブなため、パケットネットワークにおいて低遅延を実現できるIEEE802.1-Time Sensitive Networking(TSN)などの技術が注目されている。我々は、TSN の一つであるIEEE802.1Qbv 方式(Time Aware Shaper :TAS)に着目し、同方式の運用上の課題を解決するIntelligent TAS(iTAS)方式を考案し、ソフトウェア試作による原理検証などを行ってきた。今回、本方式の一部をFPGA 実装することにより従来比1000 倍の制御粒度を実現し、実際のMFH 環境における適用可能性を示した 
(英) In 5th Generation mobile communication, it is considered that Mobile Front Haul (MFH) network is integrated to Layer 2 network because of network efficiency. However, in such a network, MFH traffic may be influenced by other traffic in point of delay. As MFH traffic is delay-sensitive, IEEE802.1-Time Sensitive Networking (TSN) is paid attention because it may achieve low latency communication in packet network. In this paper, we focus on IEEE802.1Qbv (Time Aware Shaper : TAS) which is one of the queueing architecture of TSN. We have proposed the autonomous TAS method called intelligent TAS (iTAS) which could solve the operational problem previously, and have verified the principle of iTAS by using software prototype. In this paper, we implement a part of iTAS function to FPGA and achieve 1000 times more granularity
improvement. This result shows that our method can be applied to actual MFH environment.
キーワード (和) 低遅延 / レイヤ2 スイッチ / IEEE802.1TSN / IEEE802.1Qbv / iTAS / モバイルフロントホール / /  
(英) Low-latency / Layer 2 switch / IEEE802.1 TSN / IEEE802.1Qbv / iTAS / Mobile Front Haul / /  
文献情報 信学技報, vol. 119, no. 6, CS2019-5, pp. 25-30, 2019年4月.
資料番号 CS2019-5 
発行日 2019-04-11 (CS) 
ISSN Print edition: ISSN 0913-5685  Online edition: ISSN 2432-6380
著作権に
ついて
技術研究報告に掲載された論文の著作権は電子情報通信学会に帰属します.(許諾番号:10GA0019/12GB0052/13GB0056/17GB0034/18GB0034)
PDFダウンロード CS2019-5

研究会情報
研究会 CS CQ  
開催期間 2019-04-18 - 2019-04-19 
開催地(和) 大阪大学理工学 図書館 
開催地(英) Osaka Univ. Library 
テーマ(和) 光/無線アクセスとそれらの融合,QoSとQoE,通信品質の評価・計測・制御・最適化,ネットワークサービス,一般 
テーマ(英) Optical/Wireless Access and Their Integration, QoS and QoE, Assessment / Measurement / Control / Optimization of Communication Quality, Network Services, etc 
講演論文情報の詳細
申込み研究会 CS 
会議コード 2019-04-CS-CQ 
本文の言語 日本語 
タイトル(和) 低遅延レイヤ2スイッチにおける自律型Time Aware ShaperのFPGA試作 
サブタイトル(和)  
タイトル(英) FPGA prototype of autonomous Time Aware Shaper for low-latency layer 2 switch 
サブタイトル(英)  
キーワード(1)(和/英) 低遅延 / Low-latency  
キーワード(2)(和/英) レイヤ2 スイッチ / Layer 2 switch  
キーワード(3)(和/英) IEEE802.1TSN / IEEE802.1 TSN  
キーワード(4)(和/英) IEEE802.1Qbv / IEEE802.1Qbv  
キーワード(5)(和/英) iTAS / iTAS  
キーワード(6)(和/英) モバイルフロントホール / Mobile Front Haul  
キーワード(7)(和/英) /  
キーワード(8)(和/英) /  
第1著者 氏名(和/英/ヨミ) 西村 和人 / Kazuto Nishimura / ニシムラ カズト
第1著者 所属(和/英) 富士通株式会社 (略称: 富士通)
Fujitsu LTD (略称: Fujitsu)
第2著者 氏名(和/英/ヨミ) 廣田 正樹 / Masaki Hirota / ヒロタ マサキ
第2著者 所属(和/英) 富士通株式会社 (略称: 富士通)
Fujitsu LTD (略称: Fujitsu)
第3著者 氏名(和/英/ヨミ) 寺原 隆文 / Takafumi Terahara / テラハラ タカフミ
第3著者 所属(和/英) 富士通株式会社 (略称: 富士通)
Fujitsu LTD (略称: Fujitsu)
第4著者 氏名(和/英/ヨミ) 松井 秀樹 / Hideki Matsui / マツイ ヒデキ
第4著者 所属(和/英) 富士通株式会社 (略称: 富士通)
Fujitsu LTD (略称: Fujitsu)
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講演者
発表日時 2019-04-18 11:10:00 
発表時間 25 
申込先研究会 CS 
資料番号 IEICE-CS2019-5 
巻番号(vol) IEICE-119 
号番号(no) no.6 
ページ範囲 pp.25-30 
ページ数 IEICE-6 
発行日 IEICE-CS-2019-04-11 


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