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| 講演抄録／キーワード | ||
| 講演名 | 2018-02-28 16:55 コンポーネント間近接制約に基づいた混合誤り訂正機構の信頼性評価 ○呉 政訓・金子峰雄（北陸先端大）  VLD2017-102 |
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| 抄録 | （和） | LSIの微細化に伴った様々な問題の中，ソフトエラーは信頼性低下の主な要因の一つとされている．配線や部品の間隔が狭くなるにつれて，ソフトエラーに対する感受性がより高くなり，一回の誤りで複数コンポーネントが影響を受ける頻度も高くなりつつある．これまで，システムレベルの対策として，比較・リトライ機構，或いは多数決機構による誤り訂正手法が用いられてきた．しかし，複数のコンポーネントが同時に誤る場合，多数決回路が無力化される可能性がある．先行研究では，ソフトエラーの時間的・空間的広がり方を考慮したコンポーネント間近接制約を導入することで，複数コンポーネントに跨るソフトエラーに対しても多数決回路を用いることを可能とした上，２種類の誤り訂正機構を併用し各々の利点を活かす手法を提案した．本稿では，提案手法により合成されたデータパス回路に対し信頼性評価を行うことで，提案手法の有効性を議論する． |
| （英） | Among several problems with miniaturization of LSIs, soft-errors are one of serious problems to make reliability worse. As the distance among wires and components becomes smaller, susceptibility of LSI to soft-errors becomes higher. Hence, the possibility that a single soft-error affects several components at the same time becomes higher. To date, comparison-retry or majority-voting scheme is commonly used for error correction in the system level. However, when several components output corrupt data due to a single soft-error, it can make voters neutralized. The concept of adjacency constraint (AC) among components has been proposed in our preliminary study, where the temporal and the spatial ranges of a soft-error are considered simultaneously, and a system error is prevented by appropriately managing temporal and/or spatial distance of operations. Applying AC allows us to realize multi-component soft-error tolerance in the majority-voting scheme. In addition, a mixed error correction method is proposed to take advantages of two distinct error correction schemes. This paper discusses the effectiveness of those proposed methods by evaluating reliability against multiple component soft-errors. | |
| キーワード | （和） | 故障注入試験 / 耐ソフトエラー / コンポーネント間近接制約 / 混合誤り訂正機構 / 高位合成 / アルゴリ ズム３重化 / / |
| （英） | Fault Injection Test / Soft-Error Tolerance / Component Adjacency Constraint (AC) / Mixed Error Correction Scheme / High-Level Synthesis / Triple Algorithm Redundancy / / | |
| 文献情報 | 信学技報, vol. 117, no. 455, VLD2017-102, pp. 79-84, 2018年2月. | |
| 資料番号 | VLD2017-102 | |
| 発行日 | 2018-02-21 (VLD) | |
| ISSN | Print edition: ISSN 0913-5685 Online edition: ISSN 2432-6380 | |
| 著作権に ついて |
技術研究報告に掲載された論文の著作権は電子情報通信学会に帰属します．(許諾番号：10GA0019/12GB0052/13GB0056/17GB0034/18GB0034) | |
| PDFダウンロード | VLD2017-102 |
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| 研究会情報 | |
| 研究会 | VLD HWS |
| 開催期間 | 2018-02-28 - 2018-03-02 |
| 開催地（和） | 沖縄県青年会館 |
| 開催地（英） | Okinawa Seinen Kaikan |
| テーマ（和） | システムオンシリコンを支える設計技術 |
| テーマ（英） | |
| 講演論文情報の詳細 | |
| 申込み研究会 | VLD |
| 会議コード | 2018-02-VLD |
| 本文の言語 | 日本語 |
| タイトル（和） | コンポーネント間近接制約に基づいた混合誤り訂正機構の信頼性評価 |
| サブタイトル（和） | |
| タイトル（英） | Reliability Evaluation of Mixed Error Correction Scheme for Soft-Error Tolerant Datapaths |
| サブタイトル（英） | |
| キーワード(1)（和/英） | 故障注入試験 / Fault Injection Test |
| キーワード(2)（和/英） | 耐ソフトエラー / Soft-Error Tolerance |
| キーワード(3)（和/英） | コンポーネント間近接制約 / Component Adjacency Constraint (AC) |
| キーワード(4)（和/英） | 混合誤り訂正機構 / Mixed Error Correction Scheme |
| キーワード(5)（和/英） | 高位合成 / High-Level Synthesis |
| キーワード(6)（和/英） | アルゴリ ズム３重化 / Triple Algorithm Redundancy |
| キーワード(7)（和/英） | / |
| キーワード(8)（和/英） | / |
| 第1著者 氏名（和/英/ヨミ） | 呉 政訓 / Junghoon Oh / オ ジョンフン |
| 第1著者 所属（和/英） | 北陸先端科学技術大学院大学 (略称： 北陸先端大) Japan Advanced Institute Science and Technology (略称： JAIST) |
| 第2著者 氏名（和/英/ヨミ） | 金子 峰雄 / Mineo Kaneko / カネコ ミネオ |
| 第2著者 所属（和/英） | 北陸先端科学技術大学院大学 (略称： 北陸先端大) Japan Advanced Institute Science and Technology (略称： JAIST) |
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| 講演者 | 第1著者 |
| 発表日時 | 2018-02-28 16:55:00 |
| 発表時間 | 25分 |
| 申込先研究会 | VLD |
| 資料番号 | VLD2017-102 |
| 巻番号（vol） | vol.117 |
| 号番号（no） | no.455 |
| ページ範囲 | pp.79-84 |
| ページ数 | 6 |
| 発行日 | 2018-02-21 (VLD) |
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