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講演抄録/キーワード
講演名 2017-11-08 12:55
マルチコアプロセッサの効率的な設計検証に向けたプロセッサシミュレータの並列化
萱室高樹佐々木敬泰深澤祐樹近藤利夫三重大CPSY2017-45
抄録 (和) 一般にプロセッサ設計では,HDLシミュレーションを用いて設計,動作検証を行うが高速ではない.
これは,C++ベースの高速な機能シミュレータで関心領域(Region of Interest:ROI)の直前まで実行し,HDLシミュレータでROIのみ実行することで実行時間を削減できる.
しかし,マルチコアプロセッサの設計に対しては,機能シミュレータの実行時間がコア数に比例し増加するため,このような手法を用いても検証時間が長い問題がある.
高速な並列プロセッサシミュレータもいくつか提案されているが,従来シミュレータの多くは試行毎にタイミングが変化し,ROIの振る舞いが変化するため,プロセッサ検証には適さない.
そこで,本研究では,再現性を持つ並列シミュレーション手法を提案し実装,評価を行う.
評価結果から,提案手法は最大7倍の高速化を再現性を両立した上で実現した. 
(英)
キーワード (和) マルチコアプロセッサ / 設計検証 / 協調シミュレーション / 並列シミュレーション / マルチスレッド / / /  
(英) / / / / / / /  
文献情報 信学技報, vol. 117, no. 278, CPSY2017-45, pp. 53-58, 2017年11月.
資料番号 CPSY2017-45 
発行日 2017-10-31 (CPSY) 
ISSN Print edition: ISSN 0913-5685    Online edition: ISSN 2432-6380
著作権に
ついて
技術研究報告に掲載された論文の著作権は電子情報通信学会に帰属します.(許諾番号:10GA0019/12GB0052/13GB0056/17GB0034/18GB0034)
PDFダウンロード CPSY2017-45

研究会情報
研究会 VLD DC CPSY RECONF CPM ICD IE IPSJ-SLDM 
開催期間 2017-11-06 - 2017-11-08 
開催地(和) くまもと県民交流館パレア 
開催地(英) Kumamoto-Kenminkouryukan Parea 
テーマ(和) デザインガイア2017 -VLSI設計の新しい大地- 
テーマ(英) Design Gaia 2017 -New Field of VLSI Design- 
講演論文情報の詳細
申込み研究会 CPSY 
会議コード 2017-11-VLD-DC-CPSY-RECONF-CPM-ICD-IE-SLDM-EMB-ARC 
本文の言語 日本語(英語タイトルなし) 
タイトル(和) マルチコアプロセッサの効率的な設計検証に向けたプロセッサシミュレータの並列化 
サブタイトル(和)  
タイトル(英)  
サブタイトル(英)  
キーワード(1)(和/英) マルチコアプロセッサ /  
キーワード(2)(和/英) 設計検証 /  
キーワード(3)(和/英) 協調シミュレーション /  
キーワード(4)(和/英) 並列シミュレーション /  
キーワード(5)(和/英) マルチスレッド /  
キーワード(6)(和/英) /  
キーワード(7)(和/英) /  
キーワード(8)(和/英) /  
第1著者 氏名(和/英/ヨミ) 萱室 高樹 / / カヤムロ コウキ
第1著者 所属(和/英) 三重大学 (略称: 三重大)
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第2著者 氏名(和/英/ヨミ) 佐々木 敬泰 / / ササキ タカヒロ
第2著者 所属(和/英) 三重大学 (略称: 三重大)
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第3著者 氏名(和/英/ヨミ) 深澤 祐樹 / / フカザワ ユウキ
第3著者 所属(和/英) 三重大学 (略称: 三重大)
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第4著者 氏名(和/英/ヨミ) 近藤 利夫 / / コンドウ トシオ
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講演者 第1著者 
発表日時 2017-11-08 12:55:00 
発表時間 25分 
申込先研究会 CPSY 
資料番号 CPSY2017-45 
巻番号(vol) vol.117 
号番号(no) no.278 
ページ範囲 pp.53-58 
ページ数
発行日 2017-10-31 (CPSY) 


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