講演抄録/キーワード |
講演名 |
2017-09-25 13:55
COTSベース通信キャリア装置のHW/SW協調設計におけるFPGA動的部分再構成技術の適用性検討 ○保米本 徹・石井久治・松田俊哉・片山 勝・松村和之(NTT) RECONF2017-25 |
抄録 |
(和) |
通信キャリア特有のネットワーク機能をOpenCL C言語などを用いてFPGAアクセラレータボード上にプログラミングして用いる装置アーキテクチャにおいて,FPGAコンフィグのコンパイル時間の削減と1 FPGAでの動作中の機能更新(ISSU)を行うため,FPGA動的部分再構成(DPR)技術を用いることを検討している.本稿では,DPR対象の部分領域列の構造を1次元チェーン状とする制約を導入し,ワンライナー型に整形したコマンド列によるプログラムを行うことで利用率を上げることを提案し,その一部の実装を行った.その結果,GNU coreutils base64 をコマンド粒度の例に用いたとき,Intel Stratix V SGXEA7N FPGAの50%収容回路規模でISSU無し21段,ISSUあり12段の処理チェーンの設備が見込めることを示した. |
(英) |
The authors consider applying FPGA Dynamic Partial Reconfiguration (DPR) technique to carrier network equipment built with FPGA accelerator board and OpenCL C based programming, to achieve reduction of compiling time of circuit configuration and In Service Software Upgrade (ISSU) without using duplicated data plane. In this paper, assembling DPR areas into a straight chain and applying one-liner programming scheme are introduced and evaluated through a partial implementation of them. The result shows the DPR areas with GNU coreutils base64 command are expected to be placed 21 stages without ISSU and 12 stages with ISSU on Intel Stratix V SGXEA7N FPGA with 50% utilization. |
キーワード |
(和) |
ネットワーク処理 / FPGA 動的部分再構成 / インサービスソフトウェアアップグレード / / / / / |
(英) |
Network Processing / FPGA Dynamic Partial Reconfiguration / In Service Software Upgrade / / / / / |
文献情報 |
信学技報, vol. 117, no. 221, RECONF2017-25, pp. 19-24, 2017年9月. |
資料番号 |
RECONF2017-25 |
発行日 |
2017-09-18 (RECONF) |
ISSN |
Print edition: ISSN 0913-5685 Online edition: ISSN 2432-6380 |
著作権に ついて |
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RECONF2017-25 |