研究会情報 |
研究会 |
HWS |
開催期間 |
2017-09-15 - 2017-09-15 |
開催地(和) |
東京大学生産技術研究所 |
開催地(英) |
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テーマ(和) |
ハードウェアセキュリティ |
テーマ(英) |
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講演論文情報の詳細 |
申込み研究会 |
HWS |
会議コード |
2017-09-HWS |
本文の言語 |
日本語 |
タイトル(和) |
パイプライン型剰余乗算器で構成する254ビット素数BN曲線上のoptimal ateペアリング計算ハードウェアのFPGA実装評価 |
サブタイトル(和) |
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タイトル(英) |
An FPGA Implementation of Optimal Ate Pairing Hardware using Pipeline Type Modular Multiplier for BN Curve over 254 bit Prime Field |
サブタイトル(英) |
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キーワード(1)(和/英) |
ペアリング計算 / |
キーワード(2)(和/英) |
FPGA / |
キーワード(3)(和/英) |
モンゴメリ乗算 / |
キーワード(4)(和/英) |
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キーワード(5)(和/英) |
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キーワード(6)(和/英) |
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キーワード(7)(和/英) |
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キーワード(8)(和/英) |
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第1著者 氏名(和/英/ヨミ) |
長浜 佑介 / Yusuke Nagahama / ナガハマ ユウスケ |
第1著者 所属(和/英) |
横浜国立大学 (略称: 横浜国大)
Yokohama National University (略称: YNU) |
第2著者 氏名(和/英/ヨミ) |
藤本 大介 / Daisuke Fujimoto / フジモト ダイスケ |
第2著者 所属(和/英) |
奈良先端科学技術大学院大学 (略称: 奈良先端大)
Nara Institute of Science and Technology (略称: NAIST) |
第3著者 氏名(和/英/ヨミ) |
松本 勉 / Tsutomu Matsumoto / マツモト ツトム |
第3著者 所属(和/英) |
横浜国立大学 (略称: 横浜国大)
Yokohama National University (略称: YNU) |
第4著者 氏名(和/英/ヨミ) |
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第4著者 所属(和/英) |
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第5著者 氏名(和/英/ヨミ) |
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第5著者 所属(和/英) |
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第6著者 氏名(和/英/ヨミ) |
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第7著者 氏名(和/英/ヨミ) |
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第8著者 氏名(和/英/ヨミ) |
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第9著者 氏名(和/英/ヨミ) |
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第10著者 氏名(和/英/ヨミ) |
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第11著者 氏名(和/英/ヨミ) |
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第12著者 氏名(和/英/ヨミ) |
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第13著者 氏名(和/英/ヨミ) |
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第14著者 氏名(和/英/ヨミ) |
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第15著者 氏名(和/英/ヨミ) |
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第16著者 氏名(和/英/ヨミ) |
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第17著者 氏名(和/英/ヨミ) |
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第18著者 氏名(和/英/ヨミ) |
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第19著者 氏名(和/英/ヨミ) |
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第19著者 所属(和/英) |
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第20著者 氏名(和/英/ヨミ) |
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第20著者 所属(和/英) |
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講演者 |
第1著者 |
発表日時 |
2017-09-15 16:55:00 |
発表時間 |
25分 |
申込先研究会 |
HWS |
資料番号 |
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巻番号(vol) |
vol. |
号番号(no) |
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ページ範囲 |
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ページ数 |
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発行日 |
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