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講演抄録/キーワード
講演名 2017-09-15 16:55
パイプライン型剰余乗算器で構成する254ビット素数BN曲線上のoptimal ateペアリング計算ハードウェアのFPGA実装評価
長浜佑介横浜国大)・藤本大介奈良先端大)・松本 勉横浜国大
抄録 (和) 32bit分割のパイプライン型剰余乗算器と拡張ユークリッド互除法を用いた逆元演算器で構成するペアリング計算ハードウェアをXilinx社のKCU105 FPGAボードを用いて実装評価を行った. 
(英) (Not available yet)
キーワード (和) ペアリング計算 / FPGA / モンゴメリ乗算 / / / / /  
(英) / / / / / / /  
文献情報 信学技報
資料番号  
発行日  
ISSN  
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研究会情報
研究会 HWS  
開催期間 2017-09-15 - 2017-09-15 
開催地(和) 東京大学生産技術研究所 
開催地(英)  
テーマ(和) ハードウェアセキュリティ 
テーマ(英)  
講演論文情報の詳細
申込み研究会 HWS 
会議コード 2017-09-HWS 
本文の言語 日本語 
タイトル(和) パイプライン型剰余乗算器で構成する254ビット素数BN曲線上のoptimal ateペアリング計算ハードウェアのFPGA実装評価 
サブタイトル(和)  
タイトル(英) An FPGA Implementation of Optimal Ate Pairing Hardware using Pipeline Type Modular Multiplier for BN Curve over 254 bit Prime Field 
サブタイトル(英)  
キーワード(1)(和/英) ペアリング計算 /  
キーワード(2)(和/英) FPGA /  
キーワード(3)(和/英) モンゴメリ乗算 /  
キーワード(4)(和/英) /  
キーワード(5)(和/英) /  
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キーワード(8)(和/英) /  
第1著者 氏名(和/英/ヨミ) 長浜 佑介 / Yusuke Nagahama / ナガハマ ユウスケ
第1著者 所属(和/英) 横浜国立大学 (略称: 横浜国大)
Yokohama National University (略称: YNU)
第2著者 氏名(和/英/ヨミ) 藤本 大介 / Daisuke Fujimoto / フジモト ダイスケ
第2著者 所属(和/英) 奈良先端科学技術大学院大学 (略称: 奈良先端大)
Nara Institute of Science and Technology (略称: NAIST)
第3著者 氏名(和/英/ヨミ) 松本 勉 / Tsutomu Matsumoto / マツモト ツトム
第3著者 所属(和/英) 横浜国立大学 (略称: 横浜国大)
Yokohama National University (略称: YNU)
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講演者 第1著者 
発表日時 2017-09-15 16:55:00 
発表時間 25分 
申込先研究会 HWS 
資料番号  
巻番号(vol) vol. 
号番号(no)  
ページ範囲  
ページ数  
発行日  


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