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| 講演抄録／キーワード | ||
| 講演名 | 2016-11-29 14:40 ［基調講演］IoT時代に向け組合せ最適化問題を効率的に解くCMOSアニーリングマシン ○山岡雅直（日立）  VLD2016-59 CPM2016-81 ICD2016-42 IE2016-76 CPSY2016-52 DC2016-53 RECONF2016-49 エレソ技報アーカイブへのリンク：CPM2016-81 ICD2016-42 |
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| 抄録 | （和） | 組合せ最適化問題を効率よく解くアーキテクチャとしてイジングモデルを用いたCMOSアニーリングマシンを提案した。CMOSアニーリングマシンでは、組合せ最適化問題を磁性体のスピンの挙動を表すイジングモデルに写像しその収束動作により問題を解く。収束動作はCMOS回路により実現した。試作チップにより、100MHz動作が可能で実際に組合せ最適化問題が解けることを確認するとともに、従来のノイマン型計算機を用いた場合に比べて1800倍の電力効率で問題を解けることを確認した。 |
| （英） | A new computing machine, CMOS annealing machine, using Ising model that effectively solves combinatorial optimization problems is proposed. The annealing machine maps problems to an Ising model, a model to express the behavior of magnetic spins, and solves the problems by its own convergence property. The convergence is performed by CMOS circuits operations. The prototype chips achieve 100MHz operation and the operation to solve problems using Ising model is confirmed. The power efficiency of the chip is 1800-times higher than that of the conventional Von-Neumann computers. | |
| キーワード | （和） | イジングモデル / 組合せ最適化問題 / SRAM / 非ノイマン型計算機 / / / / |
| （英） | Ising model / Combinatorial optimization problem / SRAM / non Von-Neumann computer / / / / | |
| 文献情報 | 信学技報, vol. 116, no. 330, VLD2016-59, pp. 91-96, 2016年11月. | |
| 資料番号 | VLD2016-59 | |
| 発行日 | 2016-11-21 (VLD, DC, RECONF), 2016-11-22 (CPM, ICD, IE, CPSY) | |
| ISSN | Print edition: ISSN 0913-5685 Online edition: ISSN 2432-6380 | |
| 著作権に ついて |
技術研究報告に掲載された論文の著作権は電子情報通信学会に帰属します．(許諾番号：10GA0019/12GB0052/13GB0056/17GB0034/18GB0034) | |
| PDFダウンロード | VLD2016-59 CPM2016-81 ICD2016-42 IE2016-76 CPSY2016-52 DC2016-53 RECONF2016-49 エレソ技報アーカイブへのリンク：CPM2016-81 ICD2016-42 |
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| 研究会情報 | |
| 研究会 | VLD DC CPSY RECONF CPM ICD IE |
| 開催期間 | 2016-11-28 - 2016-11-30 |
| 開催地（和） | 立命館大学大阪いばらきキャンパス |
| 開催地（英） | Ritsumeikan University, Osaka Ibaraki Campus |
| テーマ（和） | デザインガイア2016 -VLSI設計の新しい大地- |
| テーマ（英） | Design Gaia 2016 -New Field of VLSI Design- |
| 講演論文情報の詳細 | |
| 申込み研究会 | VLD |
| 会議コード | 2016-11-VLD-DC-CPSY-RECONF-CPM-ICD-IE |
| 本文の言語 | 日本語 |
| タイトル（和） | IoT時代に向け組合せ最適化問題を効率的に解くCMOSアニーリングマシン |
| サブタイトル（和） | |
| タイトル（英） | CMOS Annealing Machine to Solve Combinatorial Optimization Problems for IoT Era |
| サブタイトル（英） | |
| キーワード(1)（和/英） | イジングモデル / Ising model |
| キーワード(2)（和/英） | 組合せ最適化問題 / Combinatorial optimization problem |
| キーワード(3)（和/英） | SRAM / SRAM |
| キーワード(4)（和/英） | 非ノイマン型計算機 / non Von-Neumann computer |
| キーワード(5)（和/英） | / |
| キーワード(6)（和/英） | / |
| キーワード(7)（和/英） | / |
| キーワード(8)（和/英） | / |
| 第1著者 氏名（和/英/ヨミ） | 山岡 雅直 / Masanao Yamaoka / ヤマオカ マサナオ |
| 第1著者 所属（和/英） | 株式会社日立製作所 (略称： 日立) Hitachi, Ltd. (略称： Hitachi) |
| 第2著者 氏名（和/英/ヨミ） | / / |
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| 講演者 | 第1著者 |
| 発表日時 | 2016-11-29 14:40:00 |
| 発表時間 | 50分 |
| 申込先研究会 | VLD |
| 資料番号 | VLD2016-59, CPM2016-81, ICD2016-42, IE2016-76, CPSY2016-52, DC2016-53, RECONF2016-49 |
| 巻番号（vol） | vol.116 |
| 号番号（no） | no.330(VLD), no.333(CPM), no.334(ICD), no.335(IE), no.336(CPSY), no.331(DC), no.332(RECONF) |
| ページ範囲 | pp.91-96(VLD), pp.25-30(CPM), pp.25-30(ICD), pp.25-30(IE), pp.27-32(CPSY), pp.91-96(DC), pp.49-54(RECONF) |
| ページ数 | 6 |
| 発行日 | 2016-11-21 (VLD, DC, RECONF), 2016-11-22 (CPM, ICD, IE, CPSY) |
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