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講演抄録/キーワード
講演名 2016-11-29 09:50
セレクタ論理に帰着させたバタフライ演算器のFPGA実装評価
伊東光希柳澤政生戸川 望早大VLD2016-55 DC2016-49
抄録 (和) 高速フーリエ変換(FFT)は信号処理など様々なアプリケーションで利用されるが,特に,秘匿計算で利用される準同型暗号を用いた演算ではFFTが多用され,高速なFFT処理が求められる.高速フーリエ変換の基本演算はバタフライ演算であるが,これはビットレベルで式変形を行いセレクタ論理に帰着させることで,桁上げ伝搬遅延を削減できることが知られている.本稿では,FPGAを対象にバタフライ演算器を実装し,遅延とスライス数の評価を行う.ビットレベル式変形によりセレクタ論理に帰着して積項を生成したバタフライ演算回路を論理合成したところ,セレクタ論理を用いずに積項を生成した回路と比べて,クリティカルパス遅延を最大9.4%,スライス数を最大22.3%削減できることを確認した. 
(英) (Not available yet)
キーワード (和) セレクタ論理 / 高速フーリエ変換 / FPGA / / / / /  
(英) / / / / / / /  
文献情報 信学技報, vol. 116, no. 330, VLD2016-55, pp. 67-72, 2016年11月.
資料番号 VLD2016-55 
発行日 2016-11-21 (VLD, DC) 
ISSN Print edition: ISSN 0913-5685    Online edition: ISSN 2432-6380
著作権に
ついて
技術研究報告に掲載された論文の著作権は電子情報通信学会に帰属します.(許諾番号:10GA0019/12GB0052/13GB0056/17GB0034/18GB0034)
PDFダウンロード VLD2016-55 DC2016-49

研究会情報
研究会 VLD DC CPSY RECONF CPM ICD IE  
開催期間 2016-11-28 - 2016-11-30 
開催地(和) 立命館大学大阪いばらきキャンパス 
開催地(英) Ritsumeikan University, Osaka Ibaraki Campus 
テーマ(和) デザインガイア2016 -VLSI設計の新しい大地- 
テーマ(英) Design Gaia 2016 -New Field of VLSI Design- 
講演論文情報の詳細
申込み研究会 VLD 
会議コード 2016-11-VLD-DC-CPSY-RECONF-CPM-ICD-IE 
本文の言語 日本語 
タイトル(和) セレクタ論理に帰着させたバタフライ演算器のFPGA実装評価 
サブタイトル(和)  
タイトル(英) FPGA Design and Evaluation of Selector-Logic-based Butterfly Unit 
サブタイトル(英)  
キーワード(1)(和/英) セレクタ論理 /  
キーワード(2)(和/英) 高速フーリエ変換 /  
キーワード(3)(和/英) FPGA /  
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キーワード(8)(和/英) /  
第1著者 氏名(和/英/ヨミ) 伊東 光希 / Koki Ito / イトウ コウキ
第1著者 所属(和/英) 早稲田大学 (略称: 早大)
Waseda University (略称: Waseda Univ.)
第2著者 氏名(和/英/ヨミ) 柳澤 政生 / Masao Yanagisawa / ヤナギサワ マサオ
第2著者 所属(和/英) 早稲田大学 (略称: 早大)
Waseda University (略称: Waseda Univ.)
第3著者 氏名(和/英/ヨミ) 戸川 望 / Nozomu Togawa / トガワ ノゾム
第3著者 所属(和/英) 早稲田大学 (略称: 早大)
Waseda University (略称: Waseda Univ.)
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講演者 第1著者 
発表日時 2016-11-29 09:50:00 
発表時間 25分 
申込先研究会 VLD 
資料番号 VLD2016-55, DC2016-49 
巻番号(vol) vol.116 
号番号(no) no.330(VLD), no.331(DC) 
ページ範囲 pp.67-72 
ページ数
発行日 2016-11-21 (VLD, DC) 


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