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講演抄録/キーワード
講演名 2015-05-11 15:40
Hardware Description Languageにおけるコードクローンのパターン分類
上村恭平藤原賢二飯田 元奈良先端大SS2015-5
抄録 (和) 近年,回路規模の増大と複雑化に伴い,回路の開発にHardware Description Language (HDL) が広く用いられている.
ソフトウェア開発においては,ソースコード中のコードクローンはソフトウェアの品質に悪影響を与えるとされ,コードクローンの検出手法や,その影響に関する調査などが盛んに研究されている.
しかし,回路開発におけるHDLのコード中のコードクローンの影響は明らかにされていない.

そこで,本研究ではHDLにおけるコードクローンに着目し,検出ツールを開発した.
開発した検出ツールを用いて,OpenCoresが提供するプロジェクトを対象にコードクローンの検出を行い,その結果を基にHDLにおけるコードクローンを4つのパターンに分類した 
(英) With the growth of the electric circuit size and complexity, Hardware Description Language (HDL) is widely used in hardware development.
Since code clones in the source code are said to have bad effect on software quality, developing code clone detection algorithms and investigating the effect of code clone on software quality are becoming research targets.
However, code clones in HDL code have not been investigated enough yet.

In this research, we developed a code clone detection tool for HDL and detected code clones in the HDL projects provided by Open Cores.
As a result of our investigation, we classified code clones in HDL code into four patterns.
キーワード (和) コードクローン / コードクローン検出 / Hardware Description Language / Verilog / 抽象構文木 / / /  
(英) Code Clone / Clone Detection / Hardware Description Language / Verilog / Abstract Syntax Tree / / /  
文献情報 信学技報, vol. 115, no. 20, SS2015-5, pp. 23-28, 2015年5月.
資料番号 SS2015-5 
発行日 2015-05-04 (SS) 
ISSN Print edition: ISSN 0913-5685  Online edition: ISSN 2432-6380
著作権に
ついて
技術研究報告に掲載された論文の著作権は電子情報通信学会に帰属します.(許諾番号:10GA0019/12GB0052/13GB0056/17GB0034/18GB0034)
PDFダウンロード SS2015-5

研究会情報
研究会 SS  
開催期間 2015-05-11 - 2015-05-12 
開催地(和) 熊本大学 
開催地(英) Kumamoto University 
テーマ(和) 一般,研究スタートアップ 
テーマ(英)  
講演論文情報の詳細
申込み研究会 SS 
会議コード 2015-05-SS 
本文の言語 日本語 
タイトル(和) Hardware Description Languageにおけるコードクローンのパターン分類 
サブタイトル(和)  
タイトル(英) Classification of Code Clones in Hardware Description Language 
サブタイトル(英)  
キーワード(1)(和/英) コードクローン / Code Clone  
キーワード(2)(和/英) コードクローン検出 / Clone Detection  
キーワード(3)(和/英) Hardware Description Language / Hardware Description Language  
キーワード(4)(和/英) Verilog / Verilog  
キーワード(5)(和/英) 抽象構文木 / Abstract Syntax Tree  
キーワード(6)(和/英) /  
キーワード(7)(和/英) /  
キーワード(8)(和/英) /  
第1著者 氏名(和/英/ヨミ) 上村 恭平 / Kyohei Uemura / ウエムラ キョウヘイ
第1著者 所属(和/英) 奈良先端科学技術大学院大学 (略称: 奈良先端大)
NARA INSTITUETE SCIENCE and THECNOLOGY (略称: NAIST)
第2著者 氏名(和/英/ヨミ) 藤原 賢二 / Kenji Fujiwara / フジワラ ケンジ
第2著者 所属(和/英) 奈良先端科学技術大学院大学 (略称: 奈良先端大)
NARA INSTITUETE SCIENCE and THECNOLOGY (略称: NAIST)
第3著者 氏名(和/英/ヨミ) 飯田 元 / Hajimu Iida / イイダ ハジム
第3著者 所属(和/英) 奈良先端科学技術大学院大学 (略称: 奈良先端大)
NARA INSTITUETE SCIENCE and THECNOLOGY (略称: NAIST)
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講演者
発表日時 2015-05-11 15:40:00 
発表時間 30 
申込先研究会 SS 
資料番号 IEICE-SS2015-5 
巻番号(vol) IEICE-115 
号番号(no) no.20 
ページ範囲 pp.23-28 
ページ数 IEICE-6 
発行日 IEICE-SS-2015-05-04 


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