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| 講演抄録／キーワード | ||
| 講演名 | 2015-03-06 10:25 割込み遷移削減手法を導入した組込みアセンブリコード向けSMTベースモデル検査器の開発 ○小橋潤平・竹下 淳・山根 智・櫻井孝平（金沢大）  MSS2014-100 |
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| 抄録 | （和） | 近年の発展を続けている組込みシステムにおいて, ハードウェアに依存する性質を持つソフトウェアが用いられており, 開発期間の短縮や信頼性の向上の観点から, それらの性質に対応した形式的検証手法について需要が高まっている. 本論文ではSMTソルバを用いた有界モデル検査を検証手法として採用し, アセンブリプログラムを対象とした詳細なモデル検査手法, 及びアセンブリコードのコードブロックを利用したモデル化手法について提案する. また, 提案した手法を自動的に適応する為のツールとして, アセンブリプログラムの構文解析器とモデル変換器を開発し, 実験により提案するモデル化手法の有効性を示す. |
| （英） | Recently, embedded software has properties dependent on hardware (direct operation of address spaces, memory mapped I/O, interruption, etc.) in the process of development. Thus, demands about the established method of formal verifications corresponding to those properties are increasing from the point of view of shorter development and high reliability. Our work aims at enabling a formal verification with SMT-Based Bounded Model Checking(SMT-Based BMC) for embedded assembly codes. Our proposed method generates models of assembly codes in detail with the fixed-sized bit-vectors theory. The models generated by our method include interrupts and reduces the size of the models using Interrupt Handler Execution Reduction(IHER) technique. In this paper, we have developed an automatic model checker using our method. Moreover, we show the validity of our method by experiments. |
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| キーワード | （和） | 形式的検証 / プログラム検証 / アセンブリ言語 / SMTソルバ / 有界モデル検査 / / / |
| （英） | Formal Verification / Program Checking / Assembler Language / SMT-Based BMC / Bounded Model Checking / / / | |
| 文献情報 | 信学技報, vol. 114, no. 493, MSS2014-100, pp. 53-58, 2015年3月. | |
| 資料番号 | MSS2014-100 | |
| 発行日 | 2015-02-26 (MSS) | |
| ISSN | Print edition: ISSN 0913-5685 Online edition: ISSN 2432-6380 | |
| 著作権に ついて |
技術研究報告に掲載された論文の著作権は電子情報通信学会に帰属します．(許諾番号：10GA0019/12GB0052/13GB0056/17GB0034/18GB0034) | |
| PDFダウンロード | MSS2014-100 |
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| 研究会情報 | |
| 研究会 | MSS |
| 開催期間 | 2015-03-05 - 2015-03-06 |
| 開催地（和） | ITビジネスプラザ武蔵 |
| 開催地（英） | IT Business Plaza Musashi |
| テーマ（和） | 離散事象システム及び一般、Work In Progress、計測と自動制御学会・離散事象システム部会と併催 |
| テーマ（英） | |
| 講演論文情報の詳細 | |
| 申込み研究会 | MSS |
| 会議コード | 2015-03-MSS |
| 本文の言語 | 日本語 |
| タイトル（和） | 割込み遷移削減手法を導入した組込みアセンブリコード向けSMTベースモデル検査器の開発 |
| サブタイトル（和） | |
| タイトル（英） | Development of SMT-based model checker for assembly cords using interrupts reduction technique |
| サブタイトル（英） | |
| キーワード(1)（和/英） | 形式的検証 / Formal Verification |
| キーワード(2)（和/英） | プログラム検証 / Program Checking |
| キーワード(3)（和/英） | アセンブリ言語 / Assembler Language |
| キーワード(4)（和/英） | SMTソルバ / SMT-Based BMC |
| キーワード(5)（和/英） | 有界モデル検査 / Bounded Model Checking |
| キーワード(6)（和/英） | / |
| キーワード(7)（和/英） | / |
| キーワード(8)（和/英） | / |
| 第1著者 氏名（和/英/ヨミ） | 小橋 潤平 / Junpei Kobashi / コバシ ジュンペイ |
| 第1著者 所属（和/英） | 金沢大学 (略称： 金沢大) Kanazawa University (略称： Kanazawa Univ.) |
| 第2著者 氏名（和/英/ヨミ） | 竹下 淳 / Atsushi Takeshita / タケシタ アツシ |
| 第2著者 所属（和/英） | 金沢大学 (略称： 金沢大) Kanazawa University (略称： Kanazawa Univ.) |
| 第3著者 氏名（和/英/ヨミ） | 山根 智 / Satoshi Yamane / ヤマネ サトシ |
| 第3著者 所属（和/英） | 金沢大学 (略称： 金沢大) Kanazawa University (略称： Kanazawa Univ.) |
| 第4著者 氏名（和/英/ヨミ） | 櫻井 孝平 / Kohei Sakurai / サクライ コウヘイ |
| 第4著者 所属（和/英） | 金沢大学 (略称： 金沢大) Kanazawa University (略称： Kanazawa Univ.) |
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| 講演者 | 第1著者 |
| 発表日時 | 2015-03-06 10:25:00 |
| 発表時間 | 25分 |
| 申込先研究会 | MSS |
| 資料番号 | MSS2014-100 |
| 巻番号（vol） | vol.114 |
| 号番号（no） | no.493 |
| ページ範囲 | pp.53-58 |
| ページ数 | 6 |
| 発行日 | 2015-02-26 (MSS) |
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