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| 講演抄録／キーワード | ||
| 講演名 | 2012-03-08 14:10 400ppmの送受信周波数偏差に対応可能なシリアルATA用PHY ○川本高司（日立）・鈴木正人（ルネサス エレクトロニクス）  CAS2011-129 SIP2011-149 CS2011-121 |
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| 抄録 | （和） | (まだ登録されていません) |
| （英） | A low-jitter and large-EMI-reduction spread spectrum clock generator (SSCG) for Serial-ATA (SATA) was developed. A low-jitter voltage-controlled oscillator (VCO) with a high-frequency limiter was developed to prevent the SSCG from malfunctioning. This VCO achieved far less jitter than that of a conventional VCO. An auto-calibration technique suitable for this VCO was developed to prevent the SSCG from degrading performance because of process variations. A SATA-PHY using a technique for calibrating the SSCG was developed to use an inexpensive but large frequency-variation reference oscillator. This technique was used to calibrate the SSCG output-signal frequency. This is achieved by shifting an SSCG divide ratio by utilizing the difference between an SSCG output signal frequency and a received signal frequency. These techniques were fabricated in 0.13- and 0.15-um CMOS processes. The proposed SSCG achieved a 10.0-dB reduction in EMI. The variation in the rms jitter at 1.5 GHz with spread-spectrum clocking was reduced from 2.1-7.8 ps to 1.9-3.3 ps by the proposed autocalibration technique. The proposed SATA PHY achieved less than 400-ppm production-frequency tolerance of reference clocks. | |
| キーワード | （和） | SSCG / CDR / PLL / シリアルATA / / / / |
| （英） | SSCG / CDR / PLL / Serial-ATA / / / / | |
| 文献情報 | 信学技報, vol. 111, no. 465, CAS2011-129, pp. 125-130, 2012年3月. | |
| 資料番号 | CAS2011-129 | |
| 発行日 | 2012-03-01 (CAS, SIP, CS) | |
| ISSN | Print edition: ISSN 0913-5685 Online edition: ISSN 2432-6380 | |
| 著作権に ついて |
技術研究報告に掲載された論文の著作権は電子情報通信学会に帰属します．(許諾番号：10GA0019/12GB0052/13GB0056/17GB0034/18GB0034) | |
| PDFダウンロード | CAS2011-129 SIP2011-149 CS2011-121 |
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| 研究会情報 | |
| 研究会 | CAS CS SIP |
| 開催期間 | 2012-03-08 - 2012-03-09 |
| 開催地（和） | 新潟大学駅南キャンパス「ときめいと」 |
| 開催地（英） | The University of Niigata |
| テーマ（和） | ネットワークプロセッサ，通信のための信号処理，無線LAN/PAN，一般 |
| テーマ（英） | Network Processor, Signal Processing for communication, and Wireless LAN/PAN, etc. |
| 講演論文情報の詳細 | |
| 申込み研究会 | CAS |
| 会議コード | 2012-03-CAS-CS-SIP |
| 本文の言語 | 日本語 |
| タイトル（和） | 400ppmの送受信周波数偏差に対応可能なシリアルATA用PHY |
| サブタイトル（和） | |
| タイトル（英） | A Low-Jitter 1.5-GHz and Large-EMI reduction 10-dBm Spread-Spectrum Clock Generator for Serial-ATA |
| サブタイトル（英） | |
| キーワード(1)（和/英） | SSCG / SSCG |
| キーワード(2)（和/英） | CDR / CDR |
| キーワード(3)（和/英） | PLL / PLL |
| キーワード(4)（和/英） | シリアルATA / Serial-ATA |
| キーワード(5)（和/英） | / |
| キーワード(6)（和/英） | / |
| キーワード(7)（和/英） | / |
| キーワード(8)（和/英） | / |
| 第1著者 氏名（和/英/ヨミ） | 川本 高司 / Takashi Kawamoto / カワモト タカシ |
| 第1著者 所属（和/英） | 日立 (略称： 日立) Hitachi (略称： Hitachi) |
| 第2著者 氏名（和/英/ヨミ） | 鈴木 正人 / Masato Suzuki / スズキ マサト |
| 第2著者 所属（和/英） | ルネサスエレクトロニクス (略称： ルネサス エレクトロニクス) Reness Electronics (略称： Renesas) |
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| 講演者 | 1 |
| 発表日時 | 2012-03-08 14:10:00 |
| 発表時間 | 25 |
| 申込先研究会 | CAS |
| 資料番号 | IEICE-CAS2011-129,IEICE-SIP2011-149,IEICE-CS2011-121 |
| 巻番号（vol） | IEICE-111 |
| 号番号（no） | no.465(CAS), no.466(SIP), no.467(CS) |
| ページ範囲 | pp.125-130 |
| ページ数 | IEICE-6 |
| 発行日 | IEICE-CAS-2012-03-01,IEICE-SIP-2012-03-01,IEICE-CS-2012-03-01 |
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