講演抄録/キーワード |
講演名 |
2011-09-27 09:25
高速データバスに接続されたFPGAにおけるHWボトルネックを解消するための設計フレームワーク ○荒木光一・佐藤幸紀・井口 寧(北陸先端大) RECONF2011-33 |
抄録 |
(和) |
PCI-Expressインターフェイスを搭載するリコンフィギャラブル・デバイスの登場などにより,CPUやメモリとリコンフィギャラブル・デバイス間のデータ転送速度が高くなった.
しかしながら,ハードウェアの処理時間がデータ転送時間より長い場合,データ転送を一時停止させる必要がある.
その結果,高速なデータ転送技術を用いても十分な性能を引き出すことができない.
そこで,本稿ではデータ並列性をもつループを対象とし,高いデータ転送速度を維持してリコンフィギャラブル・デバイスでハードウェア処理を行うハードウェア構成を生成するフレームワークを提案する.
実装評価により,提案フレームワークから生成されたハードウェア構成は高いデータ転送速度でハードウェア処理を実現できることを示す. |
(英) |
As reconfigurable devices with a PCI-Express interface appear in the market, the data transfer speed between the reconfigurable devices and other units increases.
However, if the Hardware execution time is longer than the data transfer time, the data transfer is suspended to wait the hardware execution.
In this paper, we propose a novel framework for implementing hardware structure which can process a data parallel loop using an reconfigurable device without suspending the data transfer.
As a result of performance evaluation, we show that hardware generated by the our framework performs well in terms of the hi-speed data transfer and the the hardware execution on an FPGA. |
キーワード |
(和) |
PCI-Express / データ並列性 / データ転送 / / / / / |
(英) |
PCI-Express / Data Parallelism / Data Transfer / / / / / |
文献情報 |
信学技報, vol. 111, no. 218, RECONF2011-33, pp. 63-68, 2011年9月. |
資料番号 |
RECONF2011-33 |
発行日 |
2011-09-19 (RECONF) |
ISSN |
Print edition: ISSN 0913-5685 Online edition: ISSN 2432-6380 |
著作権に ついて |
技術研究報告に掲載された論文の著作権は電子情報通信学会に帰属します.(許諾番号:10GA0019/12GB0052/13GB0056/17GB0034/18GB0034) |
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