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講演抄録/キーワード
講演名 2011-03-04 14:00
二段階検証による順序回路の限定モデル検査の高速化手法
尾野紀博中村一博高木一義名大)・高木直史京大VLD2010-143
抄録 (和) (まだ登録されていません) 
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文献情報 信学技報, vol. 110, no. 432, VLD2010-143, pp. 159-164, 2011年3月.
資料番号 VLD2010-143 
発行日 2011-02-23 (VLD) 
ISSN Print edition: ISSN 0913-5685  Online edition: ISSN 2432-6380
著作権に
ついて
技術研究報告に掲載された論文の著作権は電子情報通信学会に帰属します.(許諾番号:10GA0019/12GB0052/13GB0056/17GB0034/18GB0034)
PDFダウンロード VLD2010-143

研究会情報
研究会 VLD  
開催期間 2011-03-02 - 2011-03-04 
開催地(和) 沖縄県男女共同参画センター 
開催地(英) Okinawaken-Danjo-Kyodo-Sankaku Center 
テーマ(和) システムオンシリコンを支える設計技術 
テーマ(英) Design Technology for System-on-Silicon 
講演論文情報の詳細
申込み研究会 VLD 
会議コード 2011-03-VLD 
本文の言語 日本語 
タイトル(和) 二段階検証による順序回路の限定モデル検査の高速化手法 
サブタイトル(和)  
タイトル(英) Acceleration of Bounded Model Checking for Sequential Circuits with Two-phase Verification 
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第1著者 氏名(和/英/ヨミ) 尾野 紀博 / Norihiro Ono / オノ ノリヒロ
第1著者 所属(和/英) 名古屋大学 (略称: 名大)
Nagoya University (略称: Nagoya Univ.)
第2著者 氏名(和/英/ヨミ) 中村 一博 / Kazuhiro Nakamura / ナカムラ カズヒロ
第2著者 所属(和/英) 名古屋大学 (略称: 名大)
Nagoya University (略称: Nagoya Univ.)
第3著者 氏名(和/英/ヨミ) 高木 一義 / Kazuyoshi Takagi / タカギ カズヨシ
第3著者 所属(和/英) 名古屋大学 (略称: 名大)
Nagoya University (略称: Nagoya Univ.)
第4著者 氏名(和/英/ヨミ) 高木 直史 / Naofumi Takagi / タカギ ナオフミ
第4著者 所属(和/英) 京都大学 (略称: 京大)
Kyoto University (略称: Kyoto Univ.)
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講演者
発表日時 2011-03-04 14:00:00 
発表時間 25 
申込先研究会 VLD 
資料番号 IEICE-VLD2010-143 
巻番号(vol) IEICE-110 
号番号(no) no.432 
ページ範囲 pp.159-164 
ページ数 IEICE-6 
発行日 IEICE-VLD-2011-02-23 


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