講演抄録/キーワード |
講演名 |
2010-09-28 10:00
アナログ集積回路での共通重心に対応した配置手法に関する研究 ○上 慧太朗・藤吉邦洋(東京農工大) VLD2010-48 |
抄録 |
(和) |
モノリシックICは、
シリコンチップ上に一体構造として作り込まれた素子の素子値の絶対誤差(素子の設計値に対する実際の値のズレ)は大きいが
相対ばらつき(チップ内の素子の絶対誤差の差の最大値)は小さいことが知られている。
同一チップ内のキャパシタの容量の比のばらつきをより小さくすることが求められる場合、
それぞれのキャパシタを2等分割し、共通の点(共通重心)に対して点対称に配置設計することで相対ばらつきを抑制することが行われる。
この問題に対してXiaoらは、セルの相対位置が指定されたときに、複数のセル対を共通重心に対して点対称に配置する手法を提案したが、
この手法ではセル同士が重なってしまうことがある。
そこで本稿では、
Xiao らの手法の欠陥について述べるとともに、共通重心制約を満たした配置を得るデコード手法を提案し、
実験によりその有用性を確認した。 |
(英) |
Monolithic IC has a characteristic that absolute error of device parameter is large but relative variability is small.
To reduce the relative variability,
some pairs of capacitors which have been derived by dividing each original capacitor into two halves are placed symmetrically with respect to a common center point.
Xiao proposed a method of obtaining a placement that satisfies the constraint that some pairs of cells must be placed with common centroid.
But his method has a defect that some blocks may be overlapped.
Therefore, in this paper, we propose a method of obtaining a placement that satisfies the constraint. |
キーワード |
(和) |
共通重心 / sequence-pair / アナログIC / 配置 / / / / |
(英) |
common centroid / sequence-pair / analog IC / placement / / / / |
文献情報 |
信学技報, vol. 110, no. 210, VLD2010-48, pp. 37-42, 2010年9月. |
資料番号 |
VLD2010-48 |
発行日 |
2010-09-20 (VLD) |
ISSN |
Print edition: ISSN 0913-5685 Online edition: ISSN 2432-6380 |
著作権に ついて |
技術研究報告に掲載された論文の著作権は電子情報通信学会に帰属します.(許諾番号:10GA0019/12GB0052/13GB0056/17GB0034/18GB0034) |
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VLD2010-48 |