講演抄録/キーワード |
講演名 |
2010-09-17 13:40
ScalableCoreシステム2.0の実装と評価 ○坂口嘉一・高前田伸也・吉瀬謙二(東工大) RECONF2010-38 |
抄録 |
(和) |
多数のFPGA を用いたメニーコアプロセッサのプロトタイピングシステム構築手法ScalableCore を提案している.本稿では,新しいFPGA プラットフォームのScalableCore システム2.0 について述べる.本システムでは従来のScalableCore システムVersion 1 と比較して,高速なFPGA 間の通信が可能であることを確認した.また,測定した通信速度を元にタイミングモデルの考察を行った.そのタイミングモデルに従って,速度の見積もりを行ったところ,64 ノードのシミュレーション時で,ソフトウェアによるシミュレータSimMc と比較して約64 倍高速なシミュレーションが可能であることがわかった. |
(英) |
ScalableCore is a concept of prototyping system development by using a lot of FPGAs for Many-core architecture researches. In this paper, we present a new FPGA platform named ScalableCore system 2.0. This system realizes higher speed FPGA-FPGA communications than previous platform, ScalableCore System Version 1. We discussed the timing model of the system from basis of the observed communications speed. According to the timing model, we also estimate the simulation speed. To simulate a processor of 64 nodes, ScalableCore 2.0 is about 64 times faster than the software simulator; SimMc. |
キーワード |
(和) |
FPGA / メニーコアプロセッサ / 評価環境 / プロトタイピング / / / / |
(英) |
FPGA / Many-core processor / evaluation environment / prototyping / / / / |
文献情報 |
信学技報, vol. 110, no. 204, RECONF2010-38, pp. 121-126, 2010年9月. |
資料番号 |
RECONF2010-38 |
発行日 |
2010-09-09 (RECONF) |
ISSN |
Print edition: ISSN 0913-5685 Online edition: ISSN 2432-6380 |
著作権に ついて |
技術研究報告に掲載された論文の著作権は電子情報通信学会に帰属します.(許諾番号:10GA0019/12GB0052/13GB0056/17GB0034/18GB0034) |
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