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講演抄録/キーワード
講演名 2010-07-22 15:50
[招待講演]時間窓動作TDCを内蔵した2.1-2.8GHz低雑音デジタルPLL
前多 正東海林貴司ルネサス エレクトロニクス)・狐塚正樹NEC)・岡田光司ルネサス エレクトロニクス)・深石宗生NECエレソ技報アーカイブへのリンク:ICD2010-29
抄録 (和) 2.1-2.8GHz帯で動作する低雑音・低消費電力な全デジタルPLLについて述べた。PLLの位相雑音を低減するために、2段階の量子化を行うTDCで時間分解能を向上させる構成を採用した。このTDCは位相比較に必要な最小の時間窓の範囲で間欠動作を行ない消費電力の増加を抑制している。90nm標準CMOSプロセスで試作したPLLで、基準周波数40MHz、ループ帯域500KHzのときに、インバンド位相雑音-105dBc/Hz、1MHz離調周波数で-115dBc/Hzの性能を確認した。チップ占有面積は0.37mm2、消費電流は8.1mA@1.2Vであった。 
(英) A 2.1-to-2.8-GHz low-power consumption all-digital phase locked loop (ADPLL) with a time-windowed time-to-digital converter (TDC) is presented. The time-windowed TDC uses a 2-step structure with an inverter- and a vernier-delay time-quantizer to improve time resolution, which results in low phase noise. Time-windowed operation is implemented in the TDC, in which a single-shot pulse-based operation is used for low power consumption. The test chip implemented in 90-nm CMOS technology exhibits in-band phase noise of -105 dBc/Hz, where the loop-bandwidth is set to 500 kHz with a 40-MHz reference signal, and out-band noise of -115 dBc/Hz at a 1-MHz offset frequency. The chip core occupies 0.37 mm2 and the measured power consumption is 8.1 mA from a 1.2-V power supply.
キーワード (和) 全デジタルPLL / デジタル制御発振器 / 周波数シンセサイザ / 位相雑音 / 量子化雑音 / 時間-デジタル変換器 / シグマデルタ変調器 / 同期カウンタ  
(英) All-digital phase locked loop / digitally controlled oscillator / frequency synthesizer / phase noise / quantization noise / time-to-digital converter / sigma-delta modulator / synchronous counter  
文献情報 信学技報, vol. 110, no. 140, ICD2010-29, pp. 49-54, 2010年7月.
資料番号 ICD2010-29 
発行日 2010-07-15 (ICD) 
ISSN Print edition: ISSN 0913-5685  Online edition: ISSN 2432-6380
著作権に
ついて
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研究会情報
研究会 ICD ITE-IST  
開催期間 2010-07-22 - 2010-07-23 
開催地(和) 常翔学園大阪センター 
開催地(英) Josho Gakuen Osaka Center 
テーマ(和) アナログ、アナデジ混載、RF及びセンサインタフェース回路 
テーマ(英) Analog, Mixed analog and digital, RF, and sensor interface circuitry 
講演論文情報の詳細
申込み研究会 ICD 
会議コード 2010-07-ICD-IST 
本文の言語 日本語 
タイトル(和) 時間窓動作TDCを内蔵した2.1-2.8GHz低雑音デジタルPLL 
サブタイトル(和)  
タイトル(英) A 2.1-to-2.8-GHz Low-Phase-Noise All-Digital Frequency Synthesizer with a Time-Windowed Time-to-Digital Converter 
サブタイトル(英)  
キーワード(1)(和/英) 全デジタルPLL / All-digital phase locked loop  
キーワード(2)(和/英) デジタル制御発振器 / digitally controlled oscillator  
キーワード(3)(和/英) 周波数シンセサイザ / frequency synthesizer  
キーワード(4)(和/英) 位相雑音 / phase noise  
キーワード(5)(和/英) 量子化雑音 / quantization noise  
キーワード(6)(和/英) 時間-デジタル変換器 / time-to-digital converter  
キーワード(7)(和/英) シグマデルタ変調器 / sigma-delta modulator  
キーワード(8)(和/英) 同期カウンタ / synchronous counter  
第1著者 氏名(和/英/ヨミ) 前多 正 / Tadashi Maeda / マエダ タダシ
第1著者 所属(和/英) ルネサスエレクトロニクス (略称: ルネサス エレクトロニクス)
Renesas Electronics Corporation (略称: Renesas Electronics Corporation)
第2著者 氏名(和/英/ヨミ) 東海林 貴司 / Takashi Tokairin / トウカイリン タカシ
第2著者 所属(和/英) ルネサスエレクトロニクス (略称: ルネサス エレクトロニクス)
Renesas Electronics Corporation (略称: Renesas Electronics Corporation)
第3著者 氏名(和/英/ヨミ) 狐塚 正樹 / Masaki Kitsunezuka / キツネヅカ マサキ
第3著者 所属(和/英) NECシステムIPコア研究所 (略称: NEC)
System IP-core Laboratory, NEC Corporation. (略称: NEC Corp.)
第4著者 氏名(和/英/ヨミ) 岡田 光司 / Mitsuji Okada / オカダ ミツジ
第4著者 所属(和/英) ルネサスエレクトロニクス (略称: ルネサス エレクトロニクス)
Renesas Electronics Corporation (略称: Renesas Electronics Corporation)
第5著者 氏名(和/英/ヨミ) 深石 宗生 / Muneo Fukaishi / フカイシ ムネオ
第5著者 所属(和/英) NECシステムIPコア研究所 (略称: NEC)
System IP-core Laboratory, NEC Corporation. (略称: NEC Corp.)
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講演者
発表日時 2010-07-22 15:50:00 
発表時間 50 
申込先研究会 ICD 
資料番号 IEICE-ICD2010-29 
巻番号(vol) IEICE-110 
号番号(no) no.140 
ページ範囲 pp.49-54 
ページ数 IEICE-6 
発行日 IEICE-ICD-2010-07-15 


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