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講演抄録/キーワード
講演名 2010-05-21 10:25
低消費電力を実現する1Gbps Ethernet対応TCP/IPオフロードエンジンの実装と評価
田中信吾山浦隆博菅沢延彦谷澤佳道山口健作渋谷尚久東芝
抄録 (和) 昨今,映像のハイビジョン化などによる高画質化・高解像度化により,ネットワーク上を流れる映像・音声などのリッチコンテンツのデータ量が増加している.ネットワークにおける通信プロトコルには主にTCP/IPが使われているが,現在その処理はCPUによって行われているため,特に組み込み機器の分野ではCPUの動作周波数や消費電力の増大が問題となってきた.そこで我々は,専用ハードウェア(専用回路)を用いたTCP/IPオフロードエンジンNPEngineTMを開発し,従来の組み込みCPUに比べて動作周波数あたりで80倍,消費電力あたりで22~28倍の伝送レートを実現した.本稿では,NPEngineTMで用いられている提案方式(ハイブリッド構成,ダイレクト転送,パイプライン処理)を中心にNPEngineTMの構成と特長,及び,その性能評価結果について述べる. 
(英) In recent years, an increasingly large amount of high-definition video is being streamed over various networks such as the Internet. TCP/IP is commonly used as a standard communication protocol on those networks, and most of the time the protocol is processed by CPUs. However, the higher CPU processing power needed in order to handle the large amount of data being carried by video streams, etc., has been causing several issues such as higher required operating frequency and/or increased power consumption, especially in embedded systems. In order to solve these issues, we have designed and implemented a hardware-based TCP/IP offload engine, called NPEngineTM. Compared to a conventional embedded CPU, NPEngineTM achieves about 80 times higher throughput at the same operating frequency, and 22 to 28 times higher throughput at the same power consumption. In this paper, we describe NPEngineTM focusing on its key design aspects (hybrid processing, direct data transfer and pipelined processing), and its performance evaluation results.
キーワード (和) TCP/IP / オフロードエンジン / 専用回路 / アクセラレータ / FPGA / / /  
(英) TCP/IP / Offload Engine / Dedicated Circuit / Accelerator / FPGA / / /  
文献情報 信学技報, vol. 110, no. 39, NS2010-25, pp. 53-58, 2010年5月.
資料番号 NS2010-25 
発行日 2010-05-13 (NS) 
ISSN Print edition: ISSN 0913-5685  Online edition: ISSN 2432-6380

研究会情報
研究会 NS  
開催期間 2010-05-20 - 2010-05-21 
開催地(和) 機械振興会館 
開催地(英) Kikai-Shinko-Kaikan Bldg. 
テーマ(和) 高度プロトコル・ネットワーキング技術(IP及び高位レイヤルーチング・フィルタリング、マルチキャスト、品質・経路制御)、IPNWの利用技術(P2P、P4P、オーバレイ、SIP、NGN)、ネットワークシステム関連技術(システム構成法、インタフェース、アーキテクチャ、ハードウェア・ソフトウェア・ミドルウェア)、一般 
テーマ(英) Advanced Protocol and Network Control (Application level routing, QoS and Path Control, P2P, P4P, SIP), Network System Architecture (Interface, Hardware, Software) 
講演論文情報の詳細
申込み研究会 NS 
会議コード 2010-05-NS 
本文の言語 日本語 
タイトル(和) 低消費電力を実現する1Gbps Ethernet対応TCP/IPオフロードエンジンの実装と評価 
サブタイトル(和)  
タイトル(英) Implementation and Evaluation of a Low-Power TCP/IP Offload Engine for 1 Gbps Ethernet 
サブタイトル(英)  
キーワード(1)(和/英) TCP/IP / TCP/IP  
キーワード(2)(和/英) オフロードエンジン / Offload Engine  
キーワード(3)(和/英) 専用回路 / Dedicated Circuit  
キーワード(4)(和/英) アクセラレータ / Accelerator  
キーワード(5)(和/英) FPGA / FPGA  
キーワード(6)(和/英) /  
キーワード(7)(和/英) /  
キーワード(8)(和/英) /  
第1著者 氏名(和/英/ヨミ) 田中 信吾 / Shingo Tanaka / タナカ シンゴ
第1著者 所属(和/英) 株式会社東芝 (略称: 東芝)
Toshiba Corporation (略称: Toshiba Corporation)
第2著者 氏名(和/英/ヨミ) 山浦 隆博 / Takahiro Yamaura / ヤマウラ タカヒロ
第2著者 所属(和/英) 株式会社東芝 (略称: 東芝)
Toshiba Corporation (略称: Toshiba Corporation)
第3著者 氏名(和/英/ヨミ) 菅沢 延彦 / Nobuhiko Sugasawa / スガサワ ノブヒコ
第3著者 所属(和/英) 株式会社東芝 (略称: 東芝)
Toshiba Corporation (略称: Toshiba Corporation)
第4著者 氏名(和/英/ヨミ) 谷澤 佳道 / Yoshimichi Tanizawa / タニザワ ヨシミチ
第4著者 所属(和/英) 株式会社東芝 (略称: 東芝)
Toshiba Corporation (略称: Toshiba Corporation)
第5著者 氏名(和/英/ヨミ) 山口 健作 / Kensaku Yamaguchi / ヤマグチ ケンサク
第5著者 所属(和/英) 株式会社東芝 (略称: 東芝)
Toshiba Corporation (略称: Toshiba Corporation)
第6著者 氏名(和/英/ヨミ) 渋谷 尚久 / Naohisa Shibuya / シブヤ ナオヒサ
第6著者 所属(和/英) 株式会社東芝 (略称: 東芝)
Toshiba Corporation (略称: Toshiba Corporation)
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講演者
発表日時 2010-05-21 10:25:00 
発表時間 25 
申込先研究会 NS 
資料番号 IEICE-NS2010-25 
巻番号(vol) IEICE-110 
号番号(no) no.39 
ページ範囲 pp.53-58 
ページ数 IEICE-6 
発行日 IEICE-NS-2010-05-13 


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