講演抄録/キーワード |
講演名 |
2010-01-28 15:25
パワーゲーティング技術を搭載したシステムLSIの電源ノイズ抑制 ○川崎健一・中山耕一・田辺 聡・藤澤久典(富士通研) CAS2009-69 |
抄録 |
(和) |
低消費電力SoC向けに面積オーバーヘッドが小さいパワーゲーティング手法を開発した。
本手法の特徴は、回路への電源供給に必要な電源スイッチサイズを複数に分割しておき、電源復帰時に発生する電源ノイズを抑制するために、各々のスイッチサイズやスイッチオン時間間隔を最適化するということにある。今回、製品仕様に近いLSIに本手法を適用し、65nm CMOSテクノロジを用いて試作し、電源ノイズの実測を行った。その結果、電源スイッチサイズを増やすことなく、270万ゲート規模の回路におけるスイッチオン時の電源ノイズを2mV以下に抑制できたことを確認した。 |
(英) |
A power gating technique minimizing the area overhead of power switches was developed for low power SOCs.
The amount of essential power switches to deliver power supply to a circuit is preliminarily divided to plural cluster of power switches. The appropriate values including the amount of power switches and the time turning on power switches in each cluster are determined using this technique to suppress the power-supply-voltage fluctuation when power switches are turned on.
We applied this technique to a trial LSI fabricated in 65-nm CMOS technology and measured the actual power-supply-voltage fluctuation. When the power switches on the 2.7 million gate scale circuit were turned on, the fluctuation was suppressed to less than 2mV even without additional power switches. |
キーワード |
(和) |
パワーゲーティング / リーク電流 / 電源スイッチ / 突入電流 / / / / |
(英) |
Power Gating / Leakage Current / Power Switch / Rush Current / / / / |
文献情報 |
信学技報, vol. 109, no. 396, CAS2009-69, pp. 31-36, 2010年1月. |
資料番号 |
CAS2009-69 |
発行日 |
2010-01-21 (CAS) |
ISSN |
Print edition: ISSN 0913-5685 Online edition: ISSN 2432-6380 |
著作権に ついて |
技術研究報告に掲載された論文の著作権は電子情報通信学会に帰属します.(許諾番号:10GA0019/12GB0052/13GB0056/17GB0034/18GB0034) |
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CAS2009-69 |