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| 講演抄録／キーワード | ||
| 講演名 | 2009-03-10 14:15 ハッシュ関数ファミリーAURORAのハードウェア実装評価 ○秋下 徹（ソニー）・山本忠興・阿部広幸（ソニーLSIデザイン）  IT2008-88 ISEC2008-146 WBS2008-101 |
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| 抄録 | （和） | 本稿では, ハッシュ関数ファミリー AURORA のハードウェア実装に関する最適化手法および実装性能評価について報告する. AURORA は $F$ 関数内の各コンポーネントがそれぞれ小型かつ高速に実装可能であり, また AURORA の構成は高速実装から小型実装までバラエティに富んだ実装を可能としている. 0.13 $\mu {\rm m}$ CMOS 標準セルライブラリを用いた評価結果では, 256 ビット出力の AURORA-256 は高速版実装において 35.0 Kgate で 10.4 Gbpsを, 小型版実装において 8.9 Kgate で 1.1 Gbps を達成している. また, 512 ビット出力の AURORA-512 は高速版実装において 9.1 Gbps を, 小型版実装において 12.1 Kgate を実現している. これらの数値は SHA-2 の最良の実装結果と比較して十分なアドバンテージを持っており, AURORA が高いハードウェア実装性能を持ったハッシュ関数であることを示している. |
| （英） | This paper presents optimization techniques and evaluation results in hardware implementations of the hash function family AURORA. Each component in $F$-functions of AURORA can be implemented efficiently in hardware, and its design enables a variety of implementations, from high-speed to area-restricted implementations. In our evaluations using a 0.13 $\mu {\rm m}$ CMOS ASIC library, AURORA-256 achieves the highest throughput of 10.4 Gbps with area of 35.0 Kgate in a speed-optimized implementation, and the smallest area of 8.9 Kgate with throughput of 1.1 Gbps in an area-optimized implementation. AURORA-512 achieves the highest throughput of 9.1 Gbps in a speed-optimized implementation, and the smallest area of 12.1 Kgate in an area-optimized implementation. These figures are so advantageous to the best known results of hardware performance of SHA-2 that AURORA is a highly efficient hash function family in hardware implementation. |
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| キーワード | （和） | ハッシュ関数 / AURORA / ハードウェア実装 / / / / / |
| （英） | hash function / AURORA / hardware implementation / / / / / | |
| 文献情報 | 信学技報, vol. 108, no. 473, ISEC2008-146, pp. 287-294, 2009年3月. | |
| 資料番号 | ISEC2008-146 | |
| 発行日 | 2009-03-02 (IT, ISEC, WBS) | |
| ISSN | Print edition: ISSN 0913-5685 Online edition: ISSN 2432-6380 | |
| 著作権に ついて |
技術研究報告に掲載された論文の著作権は電子情報通信学会に帰属します．(許諾番号：10GA0019/12GB0052/13GB0056/17GB0034/18GB0034) | |
| PDFダウンロード | IT2008-88 ISEC2008-146 WBS2008-101 |
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| 研究会情報 | |
| 研究会 | WBS IT ISEC |
| 開催期間 | 2009-03-09 - 2009-03-10 |
| 開催地（和） | 公立はこだて未来大学（函館） |
| 開催地（英） | Hakodate Mirai Univ. |
| テーマ（和） | 一般：情報通信基礎サブソサイェティ合同研究会 |
| テーマ（英） | |
| 講演論文情報の詳細 | |
| 申込み研究会 | ISEC |
| 会議コード | 2009-03-WBS-IT-ISEC |
| 本文の言語 | 日本語 |
| タイトル（和） | ハッシュ関数ファミリーAURORAのハードウェア実装評価 |
| サブタイトル（和） | |
| タイトル（英） | Hardware Implementations of the Cryptographic Hash Function Familiy AURORA |
| サブタイトル（英） | |
| キーワード(1)（和/英） | ハッシュ関数 / hash function |
| キーワード(2)（和/英） | AURORA / AURORA |
| キーワード(3)（和/英） | ハードウェア実装 / hardware implementation |
| キーワード(4)（和/英） | / |
| キーワード(5)（和/英） | / |
| キーワード(6)（和/英） | / |
| キーワード(7)（和/英） | / |
| キーワード(8)（和/英） | / |
| 第1著者 氏名（和/英/ヨミ） | 秋下 徹 / Toru Akishita / アキシタ トオル |
| 第1著者 所属（和/英） | ソニー株式会社 (略称： ソニー) Sony Corporation (略称： Sony) |
| 第2著者 氏名（和/英/ヨミ） | 山本 忠興 / Tadaoki Yamamoto / ヤマモト タダオキ |
| 第2著者 所属（和/英） | ソニー・エルエスアイ・デザイン株式会社 (略称： ソニーLSIデザイン) Sony LSI Design Inc. (略称： Sony LSI Design) |
| 第3著者 氏名（和/英/ヨミ） | 阿部 広幸 / Hiroyuki Abe / アベ ヒロユキ |
| 第3著者 所属（和/英） | ソニー・エルエスアイ・デザイン株式会社 (略称： ソニーLSIデザイン) Sony LSI Design Inc. (略称： Sony LSI Design) |
| 第4著者 氏名（和/英/ヨミ） | / / |
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| 講演者 | 第1著者 |
| 発表日時 | 2009-03-10 14:15:00 |
| 発表時間 | 25分 |
| 申込先研究会 | ISEC |
| 資料番号 | IT2008-88, ISEC2008-146, WBS2008-101 |
| 巻番号（vol） | vol.108 |
| 号番号（no） | no.472(IT), no.473(ISEC), no.474(WBS) |
| ページ範囲 | pp.287-294 |
| ページ数 | 8 |
| 発行日 | 2009-03-02 (IT, ISEC, WBS) |
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