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講演抄録/キーワード
講演名 2008-10-24 12:30
高精度周期比較器を用いたループ特性に依存しないデジタル制御PLLの検討と試作
牧原幸伸池辺将之本久順一佐野栄一北大ICD2008-87 エレソ技報アーカイブへのリンク:ICD2008-87
抄録 (和) 本研究では,周期比較方式を用いた位相同期回路(Phase Locked Loop: PLL)の新規アーキテクチャを提案する.周期比較器を導入する事により,ループ・フィルタの特性に依存しない位相ロック動作を確認することができた.通常,周期比較のみでは位相ロック動作は得られない.提案型PLLは厳密な周期の大小比較により,符号の変わる微小な周期差が位相差を制御し位相ロック動作が得られる.提案型PLLを0.25m CMOSプロセスで回路設計し,その動作をシミュレーションで確認した.回路設計の際導入した,デジタル制御発振器の特性改善も行った.また動作確認のため試作を行い,測定により位相同期を確認した. 
(英) We proposed new architecture of phase-locked loop (PLL) by using clock-period comparison. For a digitally controlled PLL without a loop filter, we evaluated the use of a clock-period comparator (CPC). In proposed PLL, only the frequency lock operation should be performed; however, when the phases of the reference signal and the output signal approach each other, the frequency control by CPC results in the phase lock operation. Thus, the phase lock operation is also simultaneously achieved. The transfer function of proposed PLL can be derived at the frequency domain. Therefore, the lock operation is achieved following the response of a first order control system. The theoretical analysis of a phase-lock mechanism, a lock-up time, and spurious noise is discussed and confirmed through system simulation.
We designed element blocks of the proposed PLL using a 0.25-μm CMOS process. The voltage controlled oscillator (VCO) was replaced with a digitally controlled oscillator (DCO). The DCO consists of digital current controller and current controlled oscillator. As for the frequency characteristics of the DCO, secondary nonlinearity appears because the I−V characteristics of the MOSFET have secondary nonlinearity. To compensate of this, two-stage current controller was implemanted. We also confirmed a phase lock operation through SPICE simulation of the MOSFET level.
キーワード (和) 周期比較器 / ループ特性 / スプリアス / / / / /  
(英) PLL / DCO / ADPLL / / / / /  
文献情報 信学技報, vol. 108, no. 253, ICD2008-87, pp. 165-170, 2008年10月.
資料番号 ICD2008-87 
発行日 2008-10-15 (ICD) 
ISSN Print edition: ISSN 0913-5685    Online edition: ISSN 2432-6380
著作権に
ついて
技術研究報告に掲載された論文の著作権は電子情報通信学会に帰属します.(許諾番号:10GA0019/12GB0052/13GB0056/17GB0034/18GB0034)
PDFダウンロード ICD2008-87 エレソ技報アーカイブへのリンク:ICD2008-87

研究会情報
研究会 ICD ITE-IST  
開催期間 2008-10-22 - 2008-10-24 
開催地(和) 北海道大学 情報教育館3F 
開催地(英) Hokkaido University 
テーマ(和) アナログ、アナデジ混載、RF及びセンサインタフェース回路 
テーマ(英)  
講演論文情報の詳細
申込み研究会 ICD 
会議コード 2008-10-ICD-IST 
本文の言語 日本語 
タイトル(和) 高精度周期比較器を用いたループ特性に依存しないデジタル制御PLLの検討と試作 
サブタイトル(和)  
タイトル(英) All digital PLL with independent loop characteristic by using fine clock-period comparator 
サブタイトル(英)  
キーワード(1)(和/英) 周期比較器 / PLL  
キーワード(2)(和/英) ループ特性 / DCO  
キーワード(3)(和/英) スプリアス / ADPLL  
キーワード(4)(和/英) /  
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キーワード(8)(和/英) /  
第1著者 氏名(和/英/ヨミ) 牧原 幸伸 / Yukinobu Makihara / マキハラ ユキノブ
第1著者 所属(和/英) 北海道大学 (略称: 北大)
Hokkaido University (略称: Hokkaido Univ.)
第2著者 氏名(和/英/ヨミ) 池辺 将之 / Masayuki Ikebe / イケベ マサユキ
第2著者 所属(和/英) 北海道大学 (略称: 北大)
Hokkaido University (略称: Hokkaido Univ.)
第3著者 氏名(和/英/ヨミ) 本久 順一 / Junichi Motohisa / モトヒサ ジュンイチ
第3著者 所属(和/英) 北海道大学 (略称: 北大)
Hokkaido University (略称: Hokkaido Univ.)
第4著者 氏名(和/英/ヨミ) 佐野 栄一 / Eiichi Sano / サノ エイイチ
第4著者 所属(和/英) 北海道大学 (略称: 北大)
Hokkaido University (略称: Hokkaido Univ.)
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講演者 第1著者 
発表日時 2008-10-24 12:30:00 
発表時間 25分 
申込先研究会 ICD 
資料番号 ICD2008-87 
巻番号(vol) vol.108 
号番号(no) no.253 
ページ範囲 pp.165-170 
ページ数
発行日 2008-10-15 (ICD) 


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