講演抄録/キーワード |
講演名 |
2007-10-25 10:10
データ圧縮に基づく画像処理VLSIアーキテクチャとその応用 ○吉田 恒(東北大)・小林康浩(小山高専)・張山昌論・亀山充隆(東北大) SIP2007-111 ICD2007-100 IE2007-70 エレソ技報アーカイブへのリンク:ICD2007-100 |
抄録 |
(和) |
並列画像処理プロセッサ実現を高速かつ低消費電力で実現するためには,メモリモジュールとプロセッサ間の並列データ転送のための配線数を減らすことが重要となる.本研究では,差分を用いた画像圧縮法により,性能を低下させず配線数を削減するアーキテクチャを検討する.ステレオビジョンVLSIの例を用いて評価を行ったところ,処理速度一定条件下で配線数を25\%削減できた. |
(英) |
To design low-power and high-speed image processors, the reduction of the number of interconnection units plays an important role. This paper presents a data-compression-based VLSI architecture that reduces the number of interconnection units between processing elements and memory modules without performance degradation. For example of a stereo matching VLSI, the number of interconnection units is reduced to 25%. |
キーワード |
(和) |
画像圧縮 / 差分符号化 / メモリアーキテクチャ / / / / / |
(英) |
Image compression / Differential encoding / Memory architecture / / / / / |
文献情報 |
信学技報, vol. 107, no. 287, ICD2007-100, pp. 11-14, 2007年10月. |
資料番号 |
ICD2007-100 |
発行日 |
2007-10-18 (SIP, ICD, IE) |
ISSN |
Print edition: ISSN 0913-5685 Online edition: ISSN 2432-6380 |
著作権に ついて |
技術研究報告に掲載された論文の著作権は電子情報通信学会に帰属します.(許諾番号:10GA0019/12GB0052/13GB0056/17GB0034/18GB0034) |
PDFダウンロード |
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