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講演抄録/キーワード
講演名 2007-10-25 15:50
CAMを有する超並列SIMD型演算プロセッサによる効果的なAES暗号化処理
石崎雅勝熊木武志田上正治小出哲士マタウシュ ハンス ユルゲン広島大)・行天隆幸野田英行奥野義弘有本和民ルネサステクノロジCPSY2007-28
抄録 (和) 我々はこれまでに,Content Addressable Memory (CAM) を有する超並列Single Instruction Multiple Data (SIMD) 型演算プロセッサによってマルチメディア
アプリケーションの効果的な処理手法を提案してきた。画像処理アルゴリズムの一つであるJPEG処理においては,従来のDSPと比較して処理にかかるクロックサイクル数を86\%削減できるという結果を得ている.本稿では,このアーキテクチャを用いて,近年注目されている暗号アルゴリズムの中から,国際標準となっているAdvanced Encryption Standard (AES)を処理する方法を提案し,その成果について報告する.シミュレーション結果によると,Cipher Block Chaining (CBC) モードにおけるスループットは207.68 Mbpsであり,単位面積当たりのスループットは54.68 Mbps/${mm^2}$である. 
(英) We have previously reported that the Content Addressable Memory (CAM)-enhanced massive-parallel Single Instruction Multiple Data (SIMD) matrix processor has the capability of high-speed data processing for common multimedia algorithms such as JPEG.

In this paper, we propose an effective implementation of the Advanced Encryption Standard (AES) with a CAM-enhanced massive-parallel SIMD matrix processor. The AES is the common encryption algorithm which was selected by the National Institute of Standards and Technology (NIST) in U.S.A. The determined performance in throughput in the AES- Cipher Block Chaining (CBC) mode is 207.68Mbps, and throughput per area is 54.68 Mbps/${mm^2}$.
キーワード (和) SIMD / CAM / AES / マルチメディア / 超並列SIMD型演算プロセッサ / ブロック暗号 / /  
(英) SIMD / CAM / AES / Multimedia / massive-parallel SIMD Matrix Processor / block-cipher / /  
文献情報 信学技報, vol. 107, no. 276, CPSY2007-28, pp. 25-30, 2007年10月.
資料番号 CPSY2007-28 
発行日 2007-10-18 (CPSY) 
ISSN Print edition: ISSN 0913-5685    Online edition: ISSN 2432-6380
著作権に
ついて
技術研究報告に掲載された論文の著作権は電子情報通信学会に帰属します.(許諾番号:10GA0019/12GB0052/13GB0056/17GB0034/18GB0034)
PDFダウンロード CPSY2007-28

研究会情報
研究会 CPSY  
開催期間 2007-10-25 - 2007-10-26 
開催地(和) 熊本大学 
開催地(英) Kumamoto University 
テーマ(和) 先端的コンピュータシステム技術および一般 
テーマ(英) Advanced Computer Systems, etc. 
講演論文情報の詳細
申込み研究会 CPSY 
会議コード 2007-10-CPSY 
本文の言語 日本語 
タイトル(和) CAMを有する超並列SIMD型演算プロセッサによる効果的なAES暗号化処理 
サブタイトル(和)  
タイトル(英) Acceleration of AES Encryption with CAM-Enhanced Massive-Parallel SIMD Matrix Processor 
サブタイトル(英)  
キーワード(1)(和/英) SIMD / SIMD  
キーワード(2)(和/英) CAM / CAM  
キーワード(3)(和/英) AES / AES  
キーワード(4)(和/英) マルチメディア / Multimedia  
キーワード(5)(和/英) 超並列SIMD型演算プロセッサ / massive-parallel SIMD Matrix Processor  
キーワード(6)(和/英) ブロック暗号 / block-cipher  
キーワード(7)(和/英) /  
キーワード(8)(和/英) /  
第1著者 氏名(和/英/ヨミ) 石崎 雅勝 / Masakatsu Ishizaki / イシザキ マサカツ
第1著者 所属(和/英) 広島大学 (略称: 広島大)
Hiroshima University (略称: Hiroshima Univ.)
第2著者 氏名(和/英/ヨミ) 熊木 武志 / Takeshi Kumaki / クマキ タケシ
第2著者 所属(和/英) 広島大学 (略称: 広島大)
Hiroshima University (略称: Hiroshima Univ.)
第3著者 氏名(和/英/ヨミ) 田上 正治 / Masaharu Tagami / タガミ マサハル
第3著者 所属(和/英) 広島大学 (略称: 広島大)
Hiroshima University (略称: Hiroshima Univ.)
第4著者 氏名(和/英/ヨミ) 小出 哲士 / Tetsushi Koide / コイデ テツシ
第4著者 所属(和/英) 広島大学 (略称: 広島大)
Hiroshima University (略称: Hiroshima Univ.)
第5著者 氏名(和/英/ヨミ) マタウシュ ハンス ユルゲン / Hans Juergen Mattausch / マタウシュ ハンス ユルゲン
第5著者 所属(和/英) 広島大学 (略称: 広島大)
Hiroshima University (略称: Hiroshima Univ.)
第6著者 氏名(和/英/ヨミ) 行天 隆幸 / Takayuki Gyohten / ギョウテン タカユキ
第6著者 所属(和/英) 株式会社ルネサステクノロジ (略称: ルネサステクノロジ)
Renesas Technology Corp. (略称: Renesas Technology)
第7著者 氏名(和/英/ヨミ) 野田 英行 / Hideyuki Noda / ノダ ヒデユキ
第7著者 所属(和/英) 株式会社ルネサステクノロジ (略称: ルネサステクノロジ)
Renesas Technology Corp. (略称: Renesas Technology)
第8著者 氏名(和/英/ヨミ) 奥野 義弘 / Yoshihiro Okuno / オクノ ヨシヒロ
第8著者 所属(和/英) 株式会社ルネサステクノロジ (略称: ルネサステクノロジ)
Renesas Technology Corp. (略称: Renesas Technology)
第9著者 氏名(和/英/ヨミ) 有本 和民 / Kazutami Arimoto / アリモト カズタミ
第9著者 所属(和/英) 株式会社ルネサステクノロジ (略称: ルネサステクノロジ)
Renesas Technology Corp. (略称: Renesas Technology)
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講演者 第1著者 
発表日時 2007-10-25 15:50:00 
発表時間 40分 
申込先研究会 CPSY 
資料番号 CPSY2007-28 
巻番号(vol) vol.107 
号番号(no) no.276 
ページ範囲 pp.25-30 
ページ数
発行日 2007-10-18 (CPSY) 


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