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| 講演抄録／キーワード | ||
| 講演名 | 2007-03-09 09:20 リコンフィギャラブルプロセッサを用いたビタビ復号における消費電力の適応的最適化に関する研究 ○岸本有玄・春山真一郎・中川正雄（慶大）  SR2006-90 |
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| 抄録 | （和） | ビタビ復号をハードウェアで実現する研究は過去に行われてきたが、拘束長の変化といった、複数の復号条件に適応させるには複数の回路を用意する必要があった。従来の再構成が可能なハードウェアであるFPGAやCPLDを使うことで複数の回路を用意する必要なくなったが、回路の書き換えに時間がかかる欠点が存在した。本研究では、動的な再構成が可能なリコンフィギャラブルプロセッサDAPDNA-IIに拘束長が3から6までのビタビ復号機のコンテキストを実装した。またリコンフィギャラブルプロセッサを用いることで、回路の書き換え時間の短縮を想定して、ある一定のSNRにおいてBER閾値の設定を行い、拘束長を変動させるシミュレーションを実行した。その結果、スループットを6.40Mbps,に固定した場合において、回路の書き換えが頻繁に行われる状況で、最高の性能の拘束長と比べると、40％-80％程の回路電力の削減を確認した。 |
| （英） | In past time, the research that Viterbi decoder is achieved on VLSI was studied, but it was unique research that Viterbi decoder has changed constraint length or any other decode conditions. Using FPGA (Field Programmable Gate Array) and CPLD (Complex Programmable Logic Device) which are traditional reprogrammable not need to prepare more decoding circuits, but there was a failure that it takes a long time to reconfigure the circuit. In this paper, we used Reconfigurable Processor DAPDNA-II and we had implemented Viterbi decoder among four constraint length from 3 to 6. In this paper, using Reconfigurable Processor, we assumed the shortening the reconfiguration time. In certain SNR, we had set the threshold of BER and performed the simulation of changing constraint length. In the result, when the throughput was fixed on 6.40Mbps, and the reconfiguration of circuit was performing frequently, it is compared with constraint length of the best performance, we had confirmed the reduction of power consumption about 40% - 80%. | |
| キーワード | （和） | ビタビ復号 / ソフトウェア無線 / リコンフィギャラブルプロセッサ / / / / / |
| （英） | Viterbi Decode / Software Defined Radio / Reconfigurable Processor / / / / / | |
| 文献情報 | 信学技報, vol. 106, no. 558, SR2006-90, pp. 9-13, 2007年3月. | |
| 資料番号 | SR2006-90 | |
| 発行日 | 2007-03-02 (SR) | |
| ISSN | Print edition: ISSN 0913-5685 Online edition: ISSN 2432-6380 | |
| 著作権に ついて |
技術研究報告に掲載された論文の著作権は電子情報通信学会に帰属します．(許諾番号：10GA0019/12GB0052/13GB0056/17GB0034/18GB0034) | |
| PDFダウンロード | SR2006-90 |
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| 研究会情報 | |
| 研究会 | RCS MoNA WBS SR MW |
| 開催期間 | 2007-03-07 - 2007-03-09 |
| 開催地（和） | YRP |
| 開催地（英） | YRP |
| テーマ（和） | 移動通信ワークショップ |
| テーマ（英） | |
| 講演論文情報の詳細 | |
| 申込み研究会 | SR |
| 会議コード | 2007-03-RCS-MoMuC-WBS-SR-MW |
| 本文の言語 | 日本語 |
| タイトル（和） | リコンフィギャラブルプロセッサを用いたビタビ復号における消費電力の適応的最適化に関する研究 |
| サブタイトル（和） | |
| タイトル（英） | Adaptive Reduction of Power Consumption of Viterbi Decoder using Reconfigurable Processor |
| サブタイトル（英） | |
| キーワード(1)（和/英） | ビタビ復号 / Viterbi Decode |
| キーワード(2)（和/英） | ソフトウェア無線 / Software Defined Radio |
| キーワード(3)（和/英） | リコンフィギャラブルプロセッサ / Reconfigurable Processor |
| キーワード(4)（和/英） | / |
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| キーワード(6)（和/英） | / |
| キーワード(7)（和/英） | / |
| キーワード(8)（和/英） | / |
| 第1著者 氏名（和/英/ヨミ） | 岸本 有玄 / Yuken Kishimoto / キシモト ユウケン |
| 第1著者 所属（和/英） | 慶応義塾大学 (略称： 慶大) Keio University (略称： Keio Univ.) |
| 第2著者 氏名（和/英/ヨミ） | 春山 真一郎 / Shinichiro Haruyama / ハルヤマ シンイチロウ |
| 第2著者 所属（和/英） | 慶応義塾大学 (略称： 慶大) Keio University (略称： Keio Univ.) |
| 第3著者 氏名（和/英/ヨミ） | 中川 正雄 / Masao Nakagawa / ナカガワ マサオ |
| 第3著者 所属（和/英） | 慶応義塾大学 (略称： 慶大) Keio University (略称： Keio Univ.) |
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| 講演者 | 第1著者 |
| 発表日時 | 2007-03-09 09:20:00 |
| 発表時間 | 20分 |
| 申込先研究会 | SR |
| 資料番号 | SR2006-90 |
| 巻番号（vol） | vol.106 |
| 号番号（no） | no.558 |
| ページ範囲 | pp.9-13 |
| ページ数 | 5 |
| 発行日 | 2007-03-02 (SR) |
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