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研究会 発表日時 開催地 タイトル・著者 抄録 資料番号
RECONF, VLD, CPSY
(共催)
IPSJ-ARC, IPSJ-SLDM
(共催)
(連催) [詳細]
2022-01-24
17:10
ONLINE オンライン開催 Ternarizing Deep Spiking Neural Network
Man WuYirong KanVan_Tinh NguyenRenyuan ZhangYasuhiko NakashimaNAISTVLD2021-61 CPSY2021-30 RECONF2021-69
The feasibility of ternarizing spiking neural networks (SNNs... [more] VLD2021-61 CPSY2021-30 RECONF2021-69
pp.67-72
VLD, DC, RECONF, ICD, IPSJ-SLDM
(連催)
(併催) [詳細]
2021-12-02
09:20
ONLINE オンライン開催 メムキャパシタを用いたスパイキングニューラルネットワークの開発 ~ シナプス強度とキャパシタンスの変換方式改善による認識精度のロス低減 ~
澤田篤志押尾怜穏木村 睦張 任遠中島康彦奈良先端大VLD2021-32 ICD2021-42 DC2021-38 RECONF2021-40
人工知能に関する研究が急速に発展しており、人工知能の動作に特化した、低消費電力を可能とするコンピュータの開発の必要性が高... [more] VLD2021-32 ICD2021-42 DC2021-38 RECONF2021-40
pp.87-92
CPSY, DC
(共催)
IPSJ-ARC
(連催) [詳細]
2021-07-21
16:15
ONLINE オンライン開催 メムキャパシタを用いたスパイキングニューラルネットワークの開発
澤田篤志押尾怜穏野村武司張 任遠木村 睦中島康彦奈良先端大CPSY2021-11 DC2021-11
近年、機械学習の高性能化に伴い消費電力の増加が問題となっている。ニューロモルフィックシステムのうち特にスパイキングニュー... [more] CPSY2021-11 DC2021-11
pp.59-63
VLD, DC, IPSJ-SLDM, IPSJ-EMB
(連催)
CPSY, IPSJ-ARC
(連催)
CPM, ICD, IE
(共催)
RECONF
(併催) [詳細]
2018-12-07
14:35
広島 サテライトキャンパスひろしま An Efficient Multiplier Employing Time-Encoded Stochastic Computing Circuit
Tati ErlinaRenyuan ZhangYasuhiko NakashimaNAISTCPSY2018-41
A compact multiplier circuit is designed by time-encoded sto... [more] CPSY2018-41
pp.47-52
CPSY 2017-11-19
15:00
青森 青森県観光物産館アスパム [ポスター講演]A Programmable Analog Calculation Unit based on Support Vector Regression
Renyuan ZhangTakashi NakadaYasuhiko NakashimaNAISTCPSY2017-55
本研究では, 4ビット任意関数の計算を目指し, プログラム可能なアナログ演算器を開発する. 提案した効率的なサポート・ベ... [more] CPSY2017-55
pp.27-32
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