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研究会 発表日時 開催地 タイトル・著者 抄録 資料番号
CPSY, VLD, RECONF
(共催)
IPSJ-SLDM
(連催) [詳細]
2013-01-17
13:25
神奈川 慶応義塾大学 日吉キャンパス A Channel-based Communication/Synchronization Model for SW-HW Multitasking on Dynamically Partially Reconfigurable FPGAs
Krzysztof JozwikShinya HondaMasato EdahiroNagoya Univ.)・Hiroyuki TomiyamaRitsumeikan Univ.)・Hiroaki TakadaNagoya Univ.VLD2012-130 CPSY2012-79 RECONF2012-84
Dynamically Partially Reconfigurable (DPR) FPGAs allow for i... [more] VLD2012-130 CPSY2012-79 RECONF2012-84
pp.135-140
RECONF 2011-09-26
15:30
愛知 名古屋大学(NCES) Preemptive Hardware Multitasking on Dynamically Partially Reconfigurable FPGAs - Hardware and Reconfiguration Layers
Krzysztof JozwikShinya HondaNagoya Univ.)・Hiroyuki TomiyamaRitsumeikan Univ.)・Hiroaki TakadaNagoya Univ.RECONF2011-29
Preemption techniques for HW (hardware) tasks
have been stu... [more]
RECONF2011-29
pp.43-48
VLD, CPSY, RECONF
(共催)
IPSJ-SLDM
(連催) [詳細]
2010-01-27
10:25
神奈川 慶應義塾大学日吉キャンパス Effective Hardware Task Context Switching in Virtex-4 FPGAs
Krzysztof JozwikHiroyuki TomiyamaShinya HondaHiroaki TakadaNagoya Univ.VLD2009-87 CPSY2009-69 RECONF2009-72
 [more] VLD2009-87 CPSY2009-69 RECONF2009-72
pp.113-118
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