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研究会 発表日時 開催地 タイトル・著者 抄録 資料番号
ICD, SDM
(共催)
2012-08-03
13:10
北海道 札幌市男女共同参画センター 薄膜MOSトランジスタを用いた40nm CMOS高速応答デジタルLDOレギュレータ
小野内雅文大津賀一雄五十嵐康人池谷豊人森田貞幸ルネサス エレクトロニクス)・石橋孝一郎電通大)・柳沢一正ルネサス エレクトロニクスSDM2012-82 ICD2012-50
薄膜MOSトランジスタを用いた40nm CMOS高速応答デジタルLDOレギュレータを試作した。試作LDOでは印加電圧緩和... [more] SDM2012-82 ICD2012-50
pp.105-110
VLD, IPSJ-SLDM
(連催)
2010-05-20
13:05
福岡 北九州国際会議場 遅延予測技術を用いたDVFS制御向け広周波数・電源電圧レンジクロック同期回路
小野内雅文菅野雄介佐圓 真小松成亘日立)・安 義彦石橋孝一郎ルネサス エレクトロニクスVLD2010-7
モジュール単位のDVFS制御を実施する際に,電源電圧変更中のモジュール間の同期を維持するクロック同期回路の試作・評価を行... [more] VLD2010-7
pp.67-72
MSS 2010-01-21
13:25
愛知 豊田中央研究所アクタスCホール 瞬時電源遮断機構を用いたマルチコアSoC向け省電力ソフトウェア実行環境
小野内雅文十山圭介野尻 徹佐藤真琴日立)・間瀬正啓白子 準早大)・佐藤未来子東京農工大)・高田雅士伊藤雅之ルネサステクノロジ)・水野弘之日立)・並木美太郎東京農工大)・木村啓二笠原博徳早大CST2009-38
8つのCPUコアを搭載するマルチコアSoC RP2と,自動並列化コンパイラOSCARを用いて,高い処理性能と省電力を両立... [more] CST2009-38
pp.7-12
ICD, SDM
(共催)
2007-08-23
09:20
北海道 北見工業大学 54倍速AACエンコードを実現するヘテロジニアスマルチコアアーキテクチャの検討
鹿野裕明日立/早大)・伊藤雅樹戸高貴司津野田賢伸兒玉征之小野内雅文内山邦男日立)・小高俊彦日立/早大)・亀井達也永濱 衛草桶 学新田祐介ルネサステクノロジ)・和田康孝木村啓二笠原博徳早大SDM2007-143 ICD2007-71
汎用プロセッサ(CPU) コアとアクセラレータ(ACC) コアを複数個集積したヘテロジニアスマルチコアプロセッサ(HMC... [more] SDM2007-143 ICD2007-71
pp.11-16
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