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研究会 発表日時 開催地 タイトル・著者 抄録 資料番号
VLD, DC, IPSJ-SLDM
(連催)
ICD, CPM
(共催)
CPSY, RECONF
(併催) [詳細]
2012-11-26
14:55
福岡 九州大学百年講堂 履歴情報詳細化によるパス予測の高精度化の検討
十鳥弘泰馬場敬信大川 猛大津金光横田隆史宇都宮大CPSY2012-48
複雑な依存関係を持つプログラムの高速化を達成するためには,マルチコアプロセッサ上での投機的マルチスレッド実行が有効である... [more] CPSY2012-48
pp.7-12
VLD, DC, IPSJ-SLDM
(連催)
ICD, CPM
(共催)
CPSY, RECONF
(併催) [詳細]
2012-11-28
13:00
福岡 九州大学百年講堂 分散オブジェクトORBエンジンの導入によるFPGA搭載システム連携の短期間開発事例
大川 猛高野創司植竹大地横田隆史大津金光馬場敬信宇都宮大RECONF2012-56
FPGA搭載システムをPCやタブレット端末等と連携開発する際の開発期間および開発コストの削減のために、FPGA向け分散オ... [more] RECONF2012-56
pp.51-56
DC, CPSY
(併催)
2012-08-02
13:30
鳥取 とりぎん文化会館 2パス限定投機方式におけるループ展開の効果
本間勇貴十鳥弘泰大津金光大川 猛横田隆史馬場敬信宇都宮大CPSY2012-9
我々はプログラムのループをイテレーション単位で並列化し,ループ中の実行経路(パス)の実行割合の高い上位2本のパスを対象に... [more] CPSY2012-9
pp.1-6
DC, CPSY
(併催)
2012-08-02
14:00
鳥取 とりぎん文化会館 分岐予測を応用したループ内パス予測方式の検討
金海和宏十鳥弘泰大津金光大川 猛横田隆史馬場敬信宇都宮大CPSY2012-10
プログラムのループには,その実行経路において高々2つの実行経路が支配的であるという性質がある.我々は,ループ中の実行頻度... [more] CPSY2012-10
pp.7-12
VLD 2011-03-04
15:05
沖縄 沖縄県男女共同参画センター 3次元積層LSI開発のためのスケーラブルなプロトタイピング・システム
マルコ チャシン内田裕之萩本有哉宮崎崇史大川 猛池野理門松本祐教トプスシステムズ)・居村史人菊地克弥鈴木基史仲川 博青柳昌宏産総研VLD2010-145
LSIの高性能化のために3次元積層LSIが期待されているが、その開発ではチップ間信号の増加やシステム
の複雑度の増大に... [more]
VLD2010-145
pp.171-175
NS 2011-01-21
14:15
香川 香川大学 FPGAを用いたAndroid OS性能評価システムの開発
戸田賢二産総研)・大川 猛宮崎崇史松本祐教トプスシステムズNS2010-159
(事前公開アブストラクト) Android OSを搭載可能なマイコンとバス接続を行い、Android側の
イベント処理... [more]
NS2010-159
pp.97-102
ICD, IPSJ-ARC, IPSJ-EMB
(共催)
2009-01-14
09:30
大阪 松心会館(大阪) CORBA/GIOPを用いたFPGA向けオブジェクト指向プログラミング・テスト環境
大川 猛戸田賢二産総研/ITRI
A small software and a circuit system are implemented on a X... [more] ICD2008-137
pp.45-50
ICD, ITE-IST
(共催)
2006-07-27
10:30
静岡 静岡大学(浜松キャンパス内) 光ディスク用 7bit 800Msps 120mW Folding ADC
大川剛史牧川潔志尾野孝一松浦浩二瀬上雅博ソニー
光ディスク用アプリケーションをターゲットに、低電力7bit 800Msps ADCを90nm CMOS プロセスを用いて... [more] ICD2006-61
pp.7-9
RECONF 2005-09-15
11:30
広島 国民宿舎 みやじま 杜の宿 PELOC:動的再構成FPGA用自動配置配線ツール ~ フレキシブルプロセッサへの応用 ~
宮本直人大川 猛アミール ヤマックカーン アシュファクザマン岩間大介関東弘明小谷光司須川成利大見忠弘東北大
 [more] RECONF2005-32
pp.13-18
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