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| 講演抄録／キーワード | ||
| 講演名 | 2017-11-07 13:00 自己校正可能な低電源電圧動作ヒステリシスコンパレータ ○齋藤 匠・小松 聡（東京電機大）  CPM2017-80 ICD2017-39 IE2017-65 エレソ技報アーカイブへのリンク：CPM2017-80 ICD2017-39 |
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| 抄録 | （和） | 低電源電圧で動作し、オフセット電圧の自己校正が可能なヒステリシスコンパレータ回路を提案した。提案 回路は校正用のMOS トランジスタを追加した入力段、正帰還を用いた負荷段、校正用のバイアス電圧であるLeftBias とRightBias を生成する左右2 つのチャージポンプ回路から構成されている。回路の電源電圧は0.8V, 基準信号Vref は0.4V、製造誤差を模擬するモンテカルロシミュレーションを500 回行った時、入力信号Vin がVref を立ち上がり 方向へ交差する場合コンパレータの立ち上がり閾値電圧Vtrp+の平均値は0.42V、標準偏差は5mV であった。 入 力信号Vin が基準信号Vref を立ち下がり方向へ交差する場合の立ち下がり値電圧Vtrp-の平均値0.38V、標準偏差は 3mV であった。ヒステリシスコンパレータとして動作中の消費電力は0.55 μW、校正中は1.56 μWであった。提案 回路はヒステリシス特性によりコンパレータは入力信号が閾値を立ち上がり方向へ交差する場合と立ち下がり方向へ 交差する場合の二つの閾値を持つことで、入力信号へのノイズの重畳に起因する出力のばたつきを防止することがで きる。また、チャージポンプ回路を用いた自己校正機能により、トランジスタの製造ばらつきに起因するオフセット 電圧を低減することが可能である。上記のヒステリシス特性と自己校正機能により、提案回路は低消費電力が要求さ れ、ノイズの多い環境化で使用されることが想定されるセンサー機器向けのAD 変換回路などへの応用が期待できる。 |
| （英） | A Low-supply voltage operation and Self-Calibration Hysteresis comparator was proposed. The comparator contains PMOS input stage with parallel transistors for calibration, and PMOS load stage using positive feedback, and Charge pump circuit to generate bias voltage for calibration. The comparator has hysteresis characteristics. The comparator has two trip point voltages when input signal crosses reference signal from upper side or lower side. With self-calibration, the comparator's offset voltage is decreased. The comparator suites for sensor applications or low-power Analog to Digital converter circuit. |
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| キーワード | （和） | ヒステリシス / コンパレータ / 低電源電圧 / 自己校正 / 低消費電力 / / / |
| （英） | Hysteresis / Comparator / Low-Supply Voltage / Low-enegy consumption / / / / | |
| 文献情報 | 信学技報, vol. 117, no. 276, ICD2017-39, pp. 3-7, 2017年11月. | |
| 資料番号 | ICD2017-39 | |
| 発行日 | 2017-10-30 (CPM, ICD, IE) | |
| ISSN | Print edition: ISSN 0913-5685 Online edition: ISSN 2432-6380 | |
| 著作権に ついて |
技術研究報告に掲載された論文の著作権は電子情報通信学会に帰属します．(許諾番号：10GA0019/12GB0052/13GB0056/17GB0034/18GB0034) | |
| PDFダウンロード | CPM2017-80 ICD2017-39 IE2017-65 エレソ技報アーカイブへのリンク：CPM2017-80 ICD2017-39 |
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| 研究会情報 | |
| 研究会 | VLD DC CPSY RECONF CPM ICD IE IPSJ-SLDM |
| 開催期間 | 2017-11-06 - 2017-11-08 |
| 開催地（和） | くまもと県民交流館パレア |
| 開催地（英） | Kumamoto-Kenminkouryukan Parea |
| テーマ（和） | デザインガイア2017 -VLSI設計の新しい大地- |
| テーマ（英） | Design Gaia 2017 -New Field of VLSI Design- |
| 講演論文情報の詳細 | |
| 申込み研究会 | ICD |
| 会議コード | 2017-11-VLD-DC-CPSY-RECONF-CPM-ICD-IE-SLDM-EMB-ARC |
| 本文の言語 | 日本語 |
| タイトル（和） | 自己校正可能な低電源電圧動作ヒステリシスコンパレータ |
| サブタイトル（和） | |
| タイトル（英） | A Low-Voltage Operation Self-Calibration Hysteresis Comparator |
| サブタイトル（英） | |
| キーワード(1)（和/英） | ヒステリシス / Hysteresis |
| キーワード(2)（和/英） | コンパレータ / Comparator |
| キーワード(3)（和/英） | 低電源電圧 / Low-Supply Voltage |
| キーワード(4)（和/英） | 自己校正 / Low-enegy consumption |
| キーワード(5)（和/英） | 低消費電力 / |
| キーワード(6)（和/英） | / |
| キーワード(7)（和/英） | / |
| キーワード(8)（和/英） | / |
| 第1著者 氏名（和/英/ヨミ） | 齋藤 匠 / Takumi Saito / サイトウ タクミ |
| 第1著者 所属（和/英） | 東京電機大学 (略称： 東京電機大) Tokyo Denki University (略称： TDU) |
| 第2著者 氏名（和/英/ヨミ） | 小松 聡 / Satoshi Komatsu / |
| 第2著者 所属（和/英） | 東京電機大学 (略称： 東京電機大) Tokyo Denki University (略称： TDU) |
| 第3著者 氏名（和/英/ヨミ） | / / |
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| 講演者 | 第1著者 |
| 発表日時 | 2017-11-07 13:00:00 |
| 発表時間 | 25分 |
| 申込先研究会 | ICD |
| 資料番号 | CPM2017-80, ICD2017-39, IE2017-65 |
| 巻番号（vol） | vol.117 |
| 号番号（no） | no.275(CPM), no.276(ICD), no.277(IE) |
| ページ範囲 | pp.3-7 |
| ページ数 | 5 |
| 発行日 | 2017-10-30 (CPM, ICD, IE) |
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