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講演抄録/キーワード
講演名 2015-06-20 14:00
SOTBトランジスタを用いた4つ目のFlex Power FPGAチップを搭載した評価ボードAISTinoについて
小池汎平日置雅和小笠原泰弘産総研)・石垣隼人堤 利幸明大)・中川 格関川敏弘産総研RECONF2015-22
抄録 (和) Flex Power FPGAは、ボディバイアス技術を利用して、FPGAの各回路ブロックのしきい値電圧をプログラム可能とすることで、静的消費電力を大幅に削減することができる。これまでNEDO LEAPプロジェクトの一環としてSOTB(Silicon On Thin BOX)トランジスタを用いた一連のFlex Power FPGAチップの開発を進めてきた。最後となる4つ目のチップでは、それまでのデータ測定を主目的とした実験チップから脱却して、評価ボードへの搭載と、より実用性の高い応用回路をマッピングしての実利用/評価が可能となるように、機能の強化を行なった。そして、このチップを搭載した評価ボードAISTinoを開発した。本稿ではこれらの概要について報告する。 
(英) Flex Power FPGA utilizes threshold voltage programmability to reduce its static power by the body bias control of circuit blocks in the FPGA. We have been developing a series of Flex Power FPGA chips using SOTB (Silicon On Thin BOX) transistor so far. The last 4th chip is functionally enhanced, in order to embed it on the evaluation board, and to enable practical use and evaluation by mapping more practical application circuits, pulling out of basic data measuring as a experimental chip. A new evaluation board called AISTino, which is equipped with the new chip, has been also developed. In this paper, we are going to describe the overview of them.
キーワード (和) SOTB / FPGA / ボディバイアス制御 / 静的消費電力削減 / 低電圧動作 / 動作エネルギー最小化 / /  
(英) SOTB / FPGA / Body Bias Control / Static Power Reduction / Low Voltage Operation / Minimum Energy Operation / /  
文献情報 信学技報, vol. 115, no. 109, RECONF2015-22, pp. 119-124, 2015年6月.
資料番号 RECONF2015-22 
発行日 2015-06-12 (RECONF) 
ISSN Print edition: ISSN 0913-5685    Online edition: ISSN 2432-6380
著作権に
ついて
技術研究報告に掲載された論文の著作権は電子情報通信学会に帰属します.(許諾番号:10GA0019/12GB0052/13GB0056/17GB0034/18GB0034)
査読に
ついて
本技術報告は査読を経ていない技術報告であり,推敲を加えられていずれかの場に発表されることがあります.
PDFダウンロード RECONF2015-22

研究会情報
研究会 RECONF  
開催期間 2015-06-19 - 2015-06-20 
開催地(和) 京都大学 
開催地(英) Kyoto University 
テーマ(和) 「十周年記念研究会」 リコンフィギャラブルシステム、一般 
テーマ(英) the 10th anniversary celebration of RECONF: Reconfigurable Systems, etc. 
講演論文情報の詳細
申込み研究会 RECONF 
会議コード 2015-06-RECONF 
本文の言語 日本語 
タイトル(和) SOTBトランジスタを用いた4つ目のFlex Power FPGAチップを搭載した評価ボードAISTinoについて 
サブタイトル(和)  
タイトル(英) On the Evaluation Board AISTino equipped with the Fourth Flex Power FPGA chip with SOTB transistors 
サブタイトル(英)  
キーワード(1)(和/英) SOTB / SOTB  
キーワード(2)(和/英) FPGA / FPGA  
キーワード(3)(和/英) ボディバイアス制御 / Body Bias Control  
キーワード(4)(和/英) 静的消費電力削減 / Static Power Reduction  
キーワード(5)(和/英) 低電圧動作 / Low Voltage Operation  
キーワード(6)(和/英) 動作エネルギー最小化 / Minimum Energy Operation  
キーワード(7)(和/英) /  
キーワード(8)(和/英) /  
第1著者 氏名(和/英/ヨミ) 小池 汎平 / Hanpei Koike / コイケ ハンペイ
第1著者 所属(和/英) 国立研究開発法人 産業技術総合研究所 (略称: 産総研)
National Instituteof Advanced Industrial Science and Technology (略称: AIST)
第2著者 氏名(和/英/ヨミ) 日置 雅和 / Masakazu Hioki / ヒオキ マサカズ
第2著者 所属(和/英) 国立研究開発法人 産業技術総合研究所 (略称: 産総研)
National Instituteof Advanced Industrial Science and Technology (略称: AIST)
第3著者 氏名(和/英/ヨミ) 小笠原 泰弘 / Yasuhiro Ogasahara / オガサハラ ヤスヒロ
第3著者 所属(和/英) 国立研究開発法人 産業技術総合研究所 (略称: 産総研)
National Instituteof Advanced Industrial Science and Technology (略称: AIST)
第4著者 氏名(和/英/ヨミ) 石垣 隼人 / Hayato Ishigaki / イシガキ ハヤト
第4著者 所属(和/英) 明治大学 (略称: 明大)
Meiji University (略称: Meiji Univ.)
第5著者 氏名(和/英/ヨミ) 堤 利幸 / Toshiyuki Tsutsumi / ツツミ トシユキ
第5著者 所属(和/英) 明治大学 (略称: 明大)
Meiji University (略称: Meiji Univ.)
第6著者 氏名(和/英/ヨミ) 中川 格 / Tadashi Nakagawa / ナカガワ タダシ
第6著者 所属(和/英) 国立研究開発法人 産業技術総合研究所 (略称: 産総研)
National Instituteof Advanced Industrial Science and Technology (略称: AIST)
第7著者 氏名(和/英/ヨミ) 関川 敏弘 / Toshihiro Sekigawa / セキガワ トシヒロ
第7著者 所属(和/英) 国立研究開発法人 産業技術総合研究所 (略称: 産総研)
National Instituteof Advanced Industrial Science and Technology (略称: AIST)
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講演者 第1著者 
発表日時 2015-06-20 14:00:00 
発表時間 25分 
申込先研究会 RECONF 
資料番号 RECONF2015-22 
巻番号(vol) vol.115 
号番号(no) no.109 
ページ範囲 pp.119-124 
ページ数
発行日 2015-06-12 (RECONF) 


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