講演抄録/キーワード |
講演名 |
2015-04-17 14:55
[招待講演]エネルギー効率を1800倍高めたCMOSアニーリングを用いた組み合わせ最適化問題向け20kスピンイジングチップ ○山岡雅直・吉村地尋・林 真人・奥山拓哉・青木秀貴・水野弘之(日立) ICD2015-13 エレソ技報アーカイブへのリンク:ICD2015-13 |
抄録 |
(和) |
組合せ最適化問題を効率よく解くアーキテクチャとしてイジングモデルを用いた計算機を提案し、20kスピンを含んだイジング計算機チップを65nmプロセスで試作した。イジングチップでは、組合せ最適化問題を磁性体のスピンの挙動を表すイジングモデルに写像しその収束動作により問題を解く。収束動作はCMOS回路により実現した。試作チップにより、100MHz動作が可能で実際に組合せ最適化問題が解けることを確認するとともに、従来のノイマン型計算機を用いた場合に比べて1800倍の電力効率で問題を解けることを確認した。 |
(英) |
A new computing architecture using Ising model that effectively solves combinatorial optimization problems is proposed, and a 20k-spin Ising chip is fabricated in 65nm process. The chip maps problems to an Ising model, a model to express the behavior of magnetic spins, and solves the problems by its own convergence property. The convergence is performed by CMOS circuits operations. The Ising chip achieves 100MHz operation and the operation to solve problems using Ising model is confirmed. The power efficiency of the chip is 1800-times higher than that of the conventional Neumann computers. |
キーワード |
(和) |
イジングモデル / 組合せ最適化問題 / SRAM / 非ノイマン型計算機 / / / / |
(英) |
Ising model / combinatorial optimization problem / SRAM / non-Neumann computer / / / / |
文献情報 |
信学技報, vol. 115, no. 6, ICD2015-13, pp. 63-68, 2015年4月. |
資料番号 |
ICD2015-13 |
発行日 |
2015-04-09 (ICD) |
ISSN |
Print edition: ISSN 0913-5685 Online edition: ISSN 2432-6380 |
著作権に ついて |
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