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講演抄録/キーワード
講演名 2015-01-30 08:50
ニューラルネットワークを用いたストリーム画像圧縮アーキテクチャの提案
浜崎 薫柴田裕一郎小栗 清長崎大VLD2014-132 CPSY2014-141 RECONF2014-65
抄録 (和) FPGA上にアルゴリズムに特化したストリーム処理アーキテクチャを構成したリ
アルタイム画像処理システムは,FPGAのオンチップメモリ(BRAM)が持つ高いバ
ンド幅を利用することで高い処理効率を得ることができる.しかし,フレーム
間の差分画像を求める必要があるようなアプリケーションにおいては,それを
構成するBRAMの使用率が他のFPGAのリソースに比べて極端に大きくなり,大き
なFPGAを使用しなければならなかったり,BRAMにフレームバッファが確保でき
ない場合には処理効率が低下するなどの問題があった.そこで本稿では,フレー
ムバッファ用BRAMの使用率を削減し,各使用リソースのバランスを改善するた
めにニューラルネットワークを利用したストリーム画像圧縮回路を提案し,そ
の初期評価を示す. 
(英) Real-time image processing systems based on an application-specific
streamed processing architecture configured on an FPGA can achieve high
execution efficiency, making the best use of a high bandwidth offered
by on-chip block memory (BRAM). However, when a target image processing
application needs to find inter-frame differences, the utilization
ratio of BRAM is significantly increased compared to those of other
resources and a large-scale FPGA is needed. Otherwise, the efficiency
is degraded as the on-chip BRAM cannot accommodate the whole frame
buffer. In this paper, we propose a stream image compression
architecture based on neural networks to reduce the BRAM usage for
inter-frame differences, and show the results of initial evaluation.
キーワード (和) FPGA / 画像圧縮 / ニューラルネットワーク / / / / /  
(英) FPGA / image compression / neural network / / / / /  
文献情報 信学技報, vol. 114, no. 428, RECONF2014-65, pp. 129-132, 2015年1月.
資料番号 RECONF2014-65 
発行日 2015-01-22 (VLD, CPSY, RECONF) 
ISSN Print edition: ISSN 0913-5685    Online edition: ISSN 2432-6380
著作権に
ついて
技術研究報告に掲載された論文の著作権は電子情報通信学会に帰属します.(許諾番号:10GA0019/12GB0052/13GB0056/17GB0034/18GB0034)
PDFダウンロード VLD2014-132 CPSY2014-141 RECONF2014-65

研究会情報
研究会 RECONF CPSY VLD IPSJ-SLDM  
開催期間 2015-01-29 - 2015-01-30 
開催地(和) 慶應義塾大学 日吉キャンパス 
開催地(英) Hiyoshi Campus, Keio University 
テーマ(和) FPGA応用および一般 
テーマ(英) FPGA Applications, etc 
講演論文情報の詳細
申込み研究会 RECONF 
会議コード 2015-01-RECONF-CPSY-VLD-SLDM 
本文の言語 日本語 
タイトル(和) ニューラルネットワークを用いたストリーム画像圧縮アーキテクチャの提案 
サブタイトル(和)  
タイトル(英) A proposal of a stream image compression architecture using neural networks 
サブタイトル(英)  
キーワード(1)(和/英) FPGA / FPGA  
キーワード(2)(和/英) 画像圧縮 / image compression  
キーワード(3)(和/英) ニューラルネットワーク / neural network  
キーワード(4)(和/英) /  
キーワード(5)(和/英) /  
キーワード(6)(和/英) /  
キーワード(7)(和/英) /  
キーワード(8)(和/英) /  
第1著者 氏名(和/英/ヨミ) 浜崎 薫 / Kaoru Hamasaki / ハマサキ カオル
第1著者 所属(和/英) 長崎大学 (略称: 長崎大)
Nagasaki University (略称: Nagasaki Univ.)
第2著者 氏名(和/英/ヨミ) 柴田 裕一郎 / Yuichiro Shibata / シバタ ユウイチロウ
第2著者 所属(和/英) 長崎大学 (略称: 長崎大)
Nagasaki University (略称: Nagasaki Univ.)
第3著者 氏名(和/英/ヨミ) 小栗 清 / Kiyoshi Oguri / オグリ キヨシ
第3著者 所属(和/英) 長崎大学 (略称: 長崎大)
Nagasaki University (略称: Nagasaki Univ.)
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講演者 第1著者 
発表日時 2015-01-30 08:50:00 
発表時間 20分 
申込先研究会 RECONF 
資料番号 VLD2014-132, CPSY2014-141, RECONF2014-65 
巻番号(vol) vol.114 
号番号(no) no.426(VLD), no.427(CPSY), no.428(RECONF) 
ページ範囲 pp.129-132 
ページ数
発行日 2015-01-22 (VLD, CPSY, RECONF) 


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